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Verilog HDL 结构框图
Verilog HDL 结构框图原创 2017-12-19 17:48:03 · 2275 阅读 · 0 评论 -
菜鸟学习FPGA第一天——疯狂的软件
现在是北京时间22:05,在装了一天的软件之后终于写了第一个程序,第一次仿真看到了波形。 其实并不知道这串波形是啥意思,里面的代码是啥意思,只是证明我的软件终于装好了。 装了两遍软件之后对整个开发环境大概有个了解,先画个图猜想一下,不对的话后面再改。 ISE:它就是Xilinx,Spartan6 这个系列FPGA的开发环境,目前就只知道它就是一个开发环境而已,具体的功能在深究,哈哈。 M原创 2017-12-15 22:28:52 · 1297 阅读 · 0 评论