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原创 Vivado IP核调用——FIFO

FIFO（first-in-first-out），可作为以先入先出顺序存取数据的数据缓存器。读写时钟或存取速率不同时，需要一个数据缓存器作为桥梁进行存—取两端的数据传输，常用异步FIFO完成该任务。与BRAM的区别在于，FIFO无地址线，可以简单地实现缓冲数据的先入先出顺序传输，无需按地址存取数据。FIFO内存取的数据不由地址指向，而是由自动变化的读指针和写指针指向要读或写的下一个数据。

2024-12-29 13:45:28 2942

原创 Vivado IP核调用——BRAM

FPGA中BRAM的功能时序及其调用

2024-12-27 21:43:52 2334 1

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