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RSS订阅原创 时序约束理解
设置set_false_path，放松时序约束要求，不应分析设计中的逻辑路径。因为不关心点到点时序要求。跨时钟域，配置信息一般set_max_delay按照3delay来约束。
2023-12-16 20:02:10
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原创 FIFO使用时候Standard 和 FWFT模式如何选择
如果在empty有效的同时继续rd_en有效，则忽略读请求，取消VALID，并underflow有效。对于标准 FIFO 读取操作，在断言读有效后，如果 FIFO 非空，存储在FIFO中的下一个数据被驱动到输出总线（dout）上和VALID标志有效。FWFT FIFO一般称为穿透fifo，顾名思义，有数据来的时候，不管你读不读，第一拍数据都会输出在dout上，empty信号拉低。当执行写操作时，FIFO取消empty，允许您恢复有效的读操作，这由VALID的有效和underflow的取消表示。
2023-10-27 22:05:48
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原创 文件目录大小
其中目录id全局唯一，取值范围[1, 200]，本目录中文件大小范围[1, 1000]，子目录id列表个数[0,10]例如 : 1 20 (2,3) 表示目录1中文件总大小是20，有两个子目录，id分别是2和3。说明：目录1大小为20，包含一个子目录2 (大小为10)，子目录2包含一个子目录3(大小为15)，总的大小为20+10+15=45。现在输入一个文件系统中所有目录信息，以及待查询的目录 id ，返回这个目录和及该目录所有子目录的大小之和。目录id 本目录中文件大小 (子目录id列表)
2023-07-02 22:59:42
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原创 华为OD机考-模拟消息队列（C，python）
第一个数字是第一个消费者订阅的时刻，第二个数字是第一个消费者取消订阅的时刻，以此类推。*当消息发送和取消订阅发生在同一时刻时，先处理取消订阅操作，即消息不会被发送到同一时刻取消订阅的消费者。消息97在9时刻到达，此时只有第一个消费者订阅（因为第二个消费者刚好在9时刻取消订阅），消息发送给它;发布者会在给定的时刻向消息队列发送消息;*当消息发送和订阅发生在同一时刻时，先处理订阅操作，即同一时刻订阅的消费者成为消息发送的候选。消息22在2时刻到达，此时两个消费者都订阅了，消息发送给优先级最高的第二个消费者;
2023-07-02 22:43:05
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原创 华为OD机试 - 矩阵稀疏扫描（C & Python）
说明：每行里0个数 >= 1（[3/2] = 1） 是稀疏行，每列0的个数 >= 2 ([5/2] = 2)是稀疏列，有5个稀疏行，3个稀疏列。2、找出每行，每列连续的0个数，（注意是连续的0），判断是否大于等于行宽或者列宽的一半[W/2]，若大于则记数；说明：给定的3*3矩阵里，每一行和每一列内都存在2个0，行宽3，[3/2]=1,因此稀疏行3个，稀疏列3个。出现的0的个数超过了行宽或者列宽的一半[W/2](整除)，则认为该行或者该列是稀疏的。输出两行，第一行表示稀疏行的个数，第二行表示稀疏列的个数。
2023-06-26 14:03:48
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原创 华为OD机考-AI面板识别（C，python）
由于AI识别误差，每次别到的指示灯位置可能有差异，以4个坐标值描述AI识别的指示灯的大小和位置(左上角x1,y1，右下角x2,y2)，2、找出和基准灯属于同一行所有的灯进行排序。两个灯高低偏差不超过灯半径算同一行（即两个灯坐标的差 ≤ 灯高度的一半）。AI识别到面板上有N（1 ≤ N ≤ 100）个指示灯，灯大小一样，任意两个之间无重叠。1、每次在尚未排序的灯中挑选最高的灯作为的基准灯，排序后的编号列表，编号之间以空格分隔。编号 x1 y1 2 y2。*1 ≤ 编号 ≤ 100。第一行为N，表示灯的个数。
2023-06-21 11:04:26
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原创 华为OD机考-阿里巴巴找黄金宝箱2（C，python）
一贫如洗的樵夫阿里巴巴在去砍柴的路上，无意中发现了强盗集团的藏宝地，藏宝地有编号从0~N的箱子，每个箱子上面贴有一个数字。阿里巴巴念出一个咒语数字k(k
2023-06-21 10:54:19
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原创 华为OD机考-需要打开多少监视器（C，python）
某长方形停车场，每个车位上方都有对应监控器，当且仅当在当前车位或者前后左右四个方向任意一个车位范围停车时，监控器才需要打开。，设置监控器（设置成2），并把当前车位也设置监控器（设置成2）；给出某一时刻停车场的停车分布，请统计最少需要打开多少个监控器；第一行输入m，n表示长宽，满足1 < m,n
2023-06-14 18:30:07
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原创 FPGA实现数码管数字累加
一、基本原理FPGA数码管简单显示简单数码管原理上文介绍过，本文主要介绍视觉在1ms内感知不到数码管数字来回切换的变动，1ms内数字跳变，眼睛感知是数字一直在显示。二、代码原理1、显示模块：（1）根据需要显示的数字，取出个、十、百、千位数字分为存储至寄存器。（2）编制计数器，1ms（3）根据取出的最高位，确定位选的1ms变换显示的位数。（4）把需要显示的数字，转换成BCD码。（5）根据每个时钟位选的位置，把相应的BCD赋值给段选信号。（6）根据时钟显示段选信号。2、编制驱动模块：100
2022-05-04 23:52:14
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原创 FPGA数码管简单显示
一、了解数码管的原理数电的书中有介绍，如下图。具体按照接地还是接电源，分为共阴极与共阳极，本文讨论是共阳极，即低电平无效。简单的原理就是abcdefg七个管脚+dp（小数点），根据逻辑编写代码，控制亮灭，达到显示数字的效果。如果想表示两位，三位或者四位甚至更多，就需要更多的数码器，数码器的数量根据需要配置，本文讨论是4位数码器。多位数码器编写，需要分两步控制：第一步控制哪一个数码器有效（即给哪一个数码器供电），第二步针对已供电的数码器显示数字。二、代码编写的思路为了是代码清晰，可移植能力强分为三个
2022-05-04 23:34:10
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华为OD机考-C原代码
2023-06-19
空空如也
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