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RSS订阅原创 总线接口(串并行传递)
一、串行总线字面意思来看，串行就是数据是一位一位的发送，并行就是数据一组一组的发送。存储芯片DDR就是并行传输，它有一组数据线D0—D7，加DQS，DQM，这组线是一起传输的，只要有其中一位出错，数据就不能够正确传输过去，需要重新传输。而串行数据是一位一位的传，位与位之间没有联系，不会因为这位有错误，使下一位不能传输。二、并行总线并行总线由于是多个数据同时传输，需要考虑数据的协同性，这就导致了并行传输的频率不能做的很高。相对的，串行总线只有一条链路，就可以把频率做的很高，提高传输速度，
2023-03-01 20:57:45
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原创 存储带宽·
存储器的带宽决定了以存储器为中心的机器获取信息的传输速度，它是改善机器瓶颈的一个关键因素。为了提高存储器的带宽，可以采取以下措施：1、缩短存取周期；2、增加存储字长，使每个存取周期可读/写更多的二进制位数；3、增加存储体。计算方法：带宽我们一般用表示，若存储周期为，每次读/写个字节，则其带宽。如存取周期为500ns，每个存取周期可访问16位，则它的带宽为32M位/s。
2023-03-01 20:41:47
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原创 CPU的功能和组成
1、指令控制 英文Processing instructions，这是指控制程序 中指令的执行顺序。程序中的各指令之间是有严格顺 序的，必须严格按程序规定的顺序执行，才能保证计 算机系统工作的正确性。2、操作控制英文Perform an action，一条指令的功能往往 是由计算机中的部件执行一系列的.操作来实现的。 CPU要根据指令的功能，产生相应的操作控制信号， 发给相应的部件，从而控制这些部件按指令的要求进 行动作。3、时间控制英文Control time，时间控制就是对各种操作实 施时
2023-03-01 20:32:04
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原创 流水线冲突问题
流水线的三种相关冲突:资源相关、数据相关和控制相关。资源相关多条指令进入流水线后，在同一始终周期内争 用同一功能部件。这种冲突的通常解决方式 为： 1.前一个指令访存的时候，后一个指令暂 停一个时钟周期（拖慢一拍），再执行。 2.增设一个功能部件数据相关后续的指令需要的操作数， 要等到前面的指令 执行完成后并保存结果后才能获得。 数据相关 主要分为三种情况：－RAW（读后写）－WAW（写后写)－WAR（写后读）1.后面的指令需要使用到前面的所 写的数据，但是前面
2023-03-01 20:25:34
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原创 指令周期(取值和执行)
1.指令周期取出并执行一条指令所需的全部时间2.每条指令的周期不同由于各指令的功能不同，他们的周期也是不尽相同的。eg：NOP（空操作）：只有取指周期ADD（加操作）：指令周期有取指周期和执行周期两个阶段1.取指周期:取指周期的任务是根据PC中的内容从主存中取出指令代码并存放在IR中。而PC中存放的是指令的地址,根据这个地址从内存单元取出的是指令,并放在指令寄存器IR中,取指令的同时,PC加1。2.间址周期:间址周期的任务是取操作数有效地址,以一次间址为例,将指
2023-03-01 08:33:41
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原创 指令和数据的寻址方式
顺序寻址方式由于指令地址在内存中按顺序安排，当执行一段程序时，通常是一条指令接一条指令地顺序进行。也就是说，从存储器取出第1条指令，然后执行这条指令；接着从存储器取出第2条指令，再执行第二条指令；接着再取出第3条指令。[2]这种程序顺序执行的过程，称为指令的顺序寻址方式。为此，必须使用程序计数器（又称指令计数器）PC来计数指令的顺序号，该顺序号就是指令在内存中的地址。跳跃寻址方式当程序转移执行的顺序时，指令的寻址就采取跳跃寻址方式。所谓跳跃，是指下条指令的地址码不是由程序计数器给出，而是由本
2023-02-28 20:47:57
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原创 指令格式、地址码
1）零地址指令：只给出操作码OP，无显式地址，有两种情况：不需要操作数的指令，如空操作，停机，关中断。2）一地址指令：只有一个操作数,OP(A1) -> A1,如自加自减求反求补。或者需要两个操作数但其中一个操作数隐含在寄存器如ACC中，(ACC)OP(A1) ->ACC。完成一条一地址指令需要访存三次，取指令->读A1->写A1。3）二地址指令：有两个操作数，通常为算术运算和逻辑运算相关。(A1)OP(A2)->A1。完成一条一地址指令需要访存四次，取指令->
2023-02-28 20:36:45
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原创 页式虚拟存储器的地址映射过程
1.页式存储器 页式虚拟存储系统中，虚地址空间被分成等长大小的页，称为逻辑页；主存空间也被分成同样大小的页，称为物理页。相应地，虚地址分为两个字段：高字段为逻辑页号，低字段为页内地址（偏移量）；实存地址也分两个字段：高字段为物理页号，低字段为页内地址。通过页表可以把虚地址(逻辑地址）转换成物理地址。2.内页表和外页表虚地址到主存物理地址的变换表，通常称为内页表。与内页表对应的还有外页表，用于虚地址与辅存地址之间的变换。
2023-02-28 20:25:49
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原创 Pentium4的cache组织
二级和三级缓存中，数据和指令不分开存放， 一级中是分开的一级cache存储4个时钟周期二级cache存储11个时钟周期三级cache存储40个时钟周期Pentium4处理器的核心由下须四个主要部件组成：取指/译码单元 按顺序从 L2cache 中取程序指令，将它们译成一系列的微指令，并存入L1指令cache。乱序执行逻辑 依据数据相关性和资源可用性，调度微指令的执行，因而微指令可按不同于所取机器指令流的顺序被调度执行。执行单元 它执行微指令，从 L1数据
2023-02-28 20:09:31
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原创 存储器模块的两种组织方式
1.顺序方式 特点：（优点）某个模块进行存取时，其它模块不工作，某一模块出现故障时，其它模块可以照常工作，通过增添模块来扩充存储器容量比较方便，（缺点）但各模块串行工作，存储器的带宽受到了限制。2.交叉方式的特点：地址码的低位字段经过译码（片选，非门）选择不同的模块，而高位字段指向相应模块内的存储字。连续地址分布在相邻的不同模块内，同一模块内的地址是不连续的；（优点）对连续字的成块传送可实现多模块并行存取，提高了存储器的带宽。
2023-02-28 19:51:02
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原创 外围设备的特点
外围设备的定义：这个术语涉及到相当广泛的计算机部件。一般认为除了CPU和主存外，计算机系统的每一部分都可作为一个外围设备来看待。外围设备的特点：(1)外围设备的种类繁多，有各自的不同接口。(2)外围设备的速度较慢。(3)外围设备处理的信息形式多样。外围设备的基本组成:(1)存储介质：用来保存数据信息。(2)驱动装置：用于移动存储介质，对数据定位。(3)控制电路，将CPU发出的数据转化为存储介质可接受的数据或将存储介质的数据转化为CPU可接受的数据。
2023-02-22 21:24:25
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原创 CPU与外设的连接
外设都是通过读写设备上的寄存器来进行访问的，外设寄存器也成为“”I/O端口“”，而IO端口有两种编址方式：独立编址和统一编址。1）统一编址：寄存器参与内存统一编址。外设接口中的IO寄存器(即IO端口)与主存（内存）单元一样看待，每个端口占用一个存储单元的地址，将主存的一部分划分出来用作IO的地址空间。（理解：把外设的寄存器当做是一个内存地址，从而以类似访问内存相同的方式来操作。）统一编址优点是指令类型多、功能齐全，不仅使访问I/O端口可实现输入/输出操作而且可对端口进行算数逻辑运算、移位等；另
2023-02-22 21:08:03
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原创 CPU总线
1.CPU总线，是PC系统中最快的总线，也是芯片组与主板的核心。这条总线主要由CPU使用，用来与高速缓存、主存和北桥（或MCH）之间传送信息。习惯上人们把和CPU直接相关的局部总线叫做CPU总线或内部总线，而把和各种通用扩展槽相接的局部总线叫做系统总线或外部总线。具体地，CPU总线一般指CPU与芯片组之间的公用连接线,又叫前端总线（FSB）。不管是总线还是局部总线，是内部总线还是外部总线，都是为了发挥计算机的综合效率而提出的，我们可以把它们理解成城市中的主干道和一般道路。总线分为三种：地址总线，数据
2023-02-20 12:54:18
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原创 芯片扩展(位扩展，字扩展，字位扩展)
1.位扩展位扩展用于增加数据位数，各个芯片连接地址线的方式相同，但连接数据线的方式不同。同一时刻所有芯片被选中，通过片选信号连接到所有芯片。2.字扩展字扩展用于增加存储器中字的数量，各个芯片连接地址线的方式相同，连接数据线的方式也相同。同一时刻部分芯片被选中，通过片选信号或者采用译码器设计连接到相应的芯片。3.字位扩展字位同时扩展，既增加存储字的数量，又增加存储字长。各个芯片连接地址线的方式相同，但连接数据线的方式不相同。用 i组芯片实现字扩展，每组用j个芯片实现位扩
2023-02-20 12:44:19
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原创 pci总线的发展过程
PCI即Peripheral Component Interconnect，中文意思是“外围器件互联”，是由PCISIG (PCI Special Interest Group)推出的一种局部并行总线标准。PCI总线是由ISA(Industy Standard Architecture)总线发展而来的，ISA并行总线有8位和16位两种模式，时钟频率为8MHz，工作频率为33MHz/66MHz。是一种同步的独立于处理器的32位或64位局部总线。从结构上看，PCI是在CPU的供应商和原来的系统总线之间插入的一级
2023-02-20 11:56:47
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原创 计算机存储单位
计算机中存储单位一般有b，B，KB,MB,GB,TB,PB,EB,ZB,YB,BB,NB,DB存储单位之间的转换:1B = 8b1KB = 1024B1MB = 1024KB1GB = 1024MB1TB = 1024GB1PB = 1024TB1EB = 1024PB1ZB = 1024EB1YB = 1024ZB1BB = 1024YB1NB = 1024BB1DB = 1024NB
2023-02-20 11:56:35
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原创 奇偶校验码原理及实现逻辑图 海明码
1.奇偶校验码是奇校验码和偶校验码的统称，是一种最基本的检错码。它是由n-1位信息元和1位校验元组成，可以表示成为（n，n-1）。如果是奇校验码，在附加上一个校验元以后，码长为n的码字中“1”的个数为奇数个；如果是偶校验码，在附加上一个校验元以后，码长为n的码字中“1”的个数为偶数个。2.海明码是奇偶校验的一种扩充。它采用多位校验码的方式，在这些校验位中的每一位都对不同的信息数据位进行奇偶校验，通过合理地安排每个校验位对原始数据进行校验位组合，可以达到发现错误，纠正错误的目的。海明码是一种可
2022-09-19 12:46:57
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原创 十进制与8421码、5421码、2421码、余3码之间的转换
①8421码是最基本最常用的BCD码，是十进制代码中最常用的一种。在这种编码方式中，每一位二值代码的“1”都代表一个固定数值。将每位“1”所代表的二进制数加起来就可以得到它所代表的十进制数字。例:321的8421码就是3 2 1 0011 0010 0001。原因:0011=8x0+4x0+1x2+1x1=3，0010=8x0+4x0+2x1+1x0=2，0001=8x0+4x0+2x0+1x1=1。②5421码，是二-十进制代码(BCD码)的一种。5421码是一种有权码，有权BCD码就是四位二进
2022-09-12 10:35:21
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