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原创 verilog中一些宏的使用心得

最近学习代码的时候遇到了ifndefdefine `endif的组合 其实与ifdef有些类似 ，ifndef中的n就是not 所以我们可以给出如下例子来说明下 `ifndef A `define A ... `endif 所以这段代码的意思就是首先判断A存在不存在，存在的话，下面的代码就不会编译了，直接`endif 不存在的话，就预定义这个A，编译接下来的代码 所以我们可以看出，这个一组宏语句的作用就是使得某些文件不会被重复编译 ...

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1111 SV学习心得 （1）constraint{} 不需要加分号 （2）约束内部的符号要用逻辑符号

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