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RSS订阅原创 SDC create_clock
给我们当前的设计创建一个时钟，有了这个时钟之后，当前setup hold分析就有了一个基准。real_clock 实际的时钟 在电路中会进行传播 在进行时序分析以及时钟树综合的时候。，之前设置的用于DC（set_xxx_latency)的latency 无效了。在一个pin/port 上定义了多个clock，不想后边定义的的把前面覆盖掉。在一个source obiect 上 定义一个原时钟。在进行timing分析的时候，会将真实。占空比的设置 参数是列表的数据。在做完时钟树之后，会有具体的。
2023-07-03 21:18:00
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原创 AD18自定义原理图模板
新建原理图。双击原理图边角的空白处，点击如图对勾，原理图右下角模板取消。放置——绘图工具——线 绘制自己想要的模板图按P+T，进行文字添加，在右侧可以进行内容、大小、颜色的绘制自动变量的设置。在右侧Text=对话框中选择或者在parameters中直接输入。另存为，文件后缀为.schdoc放入模板文件夹中 然后 应用...
2019-04-26 17:32:26
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原创 AD18原理图绘制步骤
1.在原理图编辑界面直接点击T+P——GRIDS。栅格有线状和点状两种形式。2.当在原理图中把元器件移动到某根到导线上，一直出现连接不到的情况。解决办法：视图——栅格——切换电气栅格（Shift+E）3.设置捕获栅格一般为5mil的倍数。4.原理图与原理图库中栅格设置应一致。...
2019-04-26 15:52:14
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空空如也
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