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RSS订阅原创 【fast lint mode】
2: 通过设置PORT_LINK_CTRL_OFF.FAST_LINK_MODE =1。1： 通过设置diaag_ctrl_bus[2]=1。
2024-04-18 16:39:16
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原创 create_generated_clock
改变generated clock的source，即让generated clock和source clock的路径唯一且单一（单一是指，声明的相位边沿关系和实际的相位边沿关系一致）。工具会根据声明的source clock 找到它的master clock，同时确定source clock和master clock相位相反的关系，create_generated_clock [source_objects] //创建派生时钟的端口、网络。[ -comment comment_string] //注释。
2023-12-06 15:54:29
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原创 clk ppm
晶振的误差： （76.8 — 76.79）/76.8 ≈ 0.000130= 130*10^-6。假如使用的晶振是76.8MHz，实际使用频率是76.79MHz。ppm含义： 百万分之一。误差为 130ppm。
2023-11-29 20:03:52
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原创 【无标题】
1: TRB支持scattered data structures， scattered data buffer 支持0 byte 到16MB 长度。3： 支持TRB link， 支持环形TRB，最后一个trb指向第一个trb link。4： 支持64bit 地址，但是地址必须不能超过32bit(4G)边界。6： 支持多usb trb 传输时仲裁。2： TRB必须16byte 对齐。8： 支持streaming 传输。
2023-04-10 09:46:08
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空空如也
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