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RSS订阅原创 从零开始的FPGA生活#002
从零开始的FPGA生活 为了快速提高Verilog能力。采用边做题目边查资料的方式。HDLBits刷题 Verilog Language篇 Basics Simple wire module top_module( input in, output out ); assign out = in; endmodule Four wires module top_module( input a,b,c, output w,x,y,z ); assign w=a,x=b
2021-04-22 18:36:46
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原创 从零开始的FPGA生活#001
从零开始的FPGA生活 微电子本科毕业两年，转FPGA。有数电，Verilog基础。 成功入职FPGA开发，无人带，惶恐。自己开始摸索，先就着Verilog数字系统设计与FPGA应用和HDLBits刷题踏出职业第一步。 深感入门不易，已经专业靠边了，还是缺少许多必备知识。看了一些入门教学，不知所云。好在还是得到了一些参考书目以及进阶文章。且放在后面学。 ...
2021-04-20 17:46:48
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空空如也
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