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RSS订阅原创 07、ADC的有效位数与有效分辨率的区别
2021/12/12021-12ADC的有效位数与有效分辨率的区别ADC的分辨率位数(N)可决定ADC的动态范围(DR)，其代表ADC可测量的输入信号等级范围，通常以[dB]为单位。DR可定义为：请注意，由于信号在给定时间视窗内的RMS幅值取决于信号幅值在该时间视窗内如何变化，因此ADC的DR变化取决于输入信号特征。对于其满量程范围(FSR)内的恒定DC输入而言，理想的N位ADC可分别测量FSR和FSR/2N的最大及最小RMS幅值。因此，ADC的DR为：同理，对于幅值随ADCFSR变化而变化的
2021-12-01 17:35:11
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原创 06、DDR4 IP的生成流程
DDR4 IP的生成流程硬件平台：xilinx官方zcu208(xczu48dr-fsvg1517-2-e-es1)开发板软件平台：win10 + vivado 2020.21、常规的模式controller and physical layer，这个模式也是很常用的模式，750ps这个地方就是选择速率为1333MHz，实际速率是2666MHz(1333MHz*2)，4:1就是分频1333MHz得到的时钟，这里不能选2:1，分频后的时钟就是用户处理数据的时钟，3334这个地方就是参考时钟输入大小；
2021-11-30 18:59:47
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原创 05、在verilog中取对数$clog的函数
计算2的次方的对数，$clog(2)在仿真的时候是2的对数，实际在FPGA中是e（2.71828）的对数,只能用函数的方式实现，使用的时候，调用这个函数即可//funclog2（num） num必须为常数function integer funclog2;input integer value;beginvalue = value -1;beginfor(funclog2 = 0 ; value > 0 ; funclog2 = funclog2 + 1)value = value
2021-11-29 13:29:25
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原创 04、DDR不同类型的区别和硬盘接口分类
2021/11/272021-04DDR不同类型的区别和硬盘接口分类DDR不同类型的区别DIMM简介DIMM（Dual Inline Memory Module，双列直插内存模块）与SIMM(single in-line memory module，单边接触内存模组)相当类似，不同的只是DIMM的金手指两端不像SIMM那样是互通的，它们各自独立传输信号，因此可以满足更多数据信号的传送需要。同样采用DIMM，SDRAM的接口与DDR内存的接口也略有不同，SDRAM DIMM为168Pin DIMM结
2021-11-27 16:01:46
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原创 03、关于FIFO IP核使用的一点注意事项
2021/11/26版本：2021-03下面讲解几点关于FIFO IP核使用时的注意事项，想到哪里到哪里!位宽转换分布式ram资源的FIFO不能变换位宽Block RAM资源可以变化位宽Builtin FIFO资源不能变化位宽FIFO 安全电路FIFO定制页面存在一个Enable Safety Circuit，如下：选择此选项，存在两个额外输出信号：如果不选择Enable Safety Circuit，则不存在这两个信号输出：此选项仅仅针对基于Bram资源的FIFO定制
2021-11-26 17:34:31
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空空如也
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