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FPGA
潇潇谷雨
这个作者很懒,什么都没留下…
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信号跨时钟域处理
转载:http://www.eetop.cn/blog/html/34/840234-28943.html亚稳态概念 处理亚稳态的方法 异步通信,握手信号时序图转载 2018-09-13 21:12:25 · 513 阅读 · 0 评论 -
静态时序分析
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建立时间与保持时间的范围
转载:https://blog.csdn.net/moon9999/article/details/77978999题目:时钟周期为T,触发器D1的时钟沿到来到触发器Q变化的时间Tcq(CLK--Q)最大为T1max,最小为T1min,逻辑组合电路的延迟时间最大为T2max,最小为T2min,问触发器D2的建立时间和保持时间。...转载 2018-10-16 21:22:49 · 329 阅读 · 0 评论 -
关于时钟分频器设计
转载:https://blog.csdn.net/moon9999/article/details/75020355#comments分类:偶分频模块设计 奇分频模块设计 半分频模块设计 总结: 分频系数M 和 计数器值N M = 输入时钟频率/输出时钟频率 N = M/2 注意:奇数分频器需要在时钟上升沿和时钟下降沿进行计数。 ...转载 2018-10-16 21:55:13 · 1773 阅读 · 0 评论