1.影响处理器执行程序所需时间的因素主要有3个，total instructions(程序所包含的指令的总数量，总量越多，需要的时间越久),instructions per cycle（每个时钟周期能所执行的指令个数，简称IPC）,cycle time（时钟频率）,超标量处理器的设计就是提升IPC来缩短程序执行的时间。
2.超标量处理器的概念
（1）标量处理器：每个时钟周期最多执行一条指令，IPC<=1
（2）超标量处理器（superscalar）：每个时钟周期可以执行多条指令,IPC可以>1，其中超标量处理器又分为顺序执行（in-order）和乱序执行(out-of-order)。（后面会对顺序执行和乱序执行进行详细解释）
2.标量处理器知识回顾
（1）计算机执行一条指令通常需要五个阶段
·取指令（fetch）：使用PC寄存器里的值作为地址，从地址对应的指令存储器中取出指令，并且将取出的指令放到指令寄存器中。（如果各种存储器、寄存器之类的名字没概念很头大，可以先不用管这些，只需要知道存储器在CPU外围，速度较慢，寄存器在CPU内部，速度很快，重点放在理解这套操作的逻辑上）
·指令译码（decode）：对指令进行解码，并且根据解码的值读取出寄存器得到源操作数。注： add r3,r2,r1//该指令的功能是将寄存器r1和r2里的值相加，结果送入r3,其中r1,r2就是源操作数。
·指令执行（execute）:根据指令的类型完成计算（如加减乘除）
·访存（memory）:将执行的结果写入到存储器（只对需要访问内存的指令起作用，其他指令在这个阶段不会做任何事情）
·写回（write back）:将指令运算的结果写回到目的寄存器中。（为什么要写回，因为这一步运算得出的结果可能是下一步运算的源操作数）
（2）流水线技术
上面提到的CPU执行一条指令需要5个步骤，假设每个步骤需要一个时钟周期的时间来完成（有些可能需要更多个时钟周期，此处以1时钟周期为例），则执行完一条指令做需要的时间为5个时钟周期。当前这条指令执行完（花费了5个时钟周期）之后，重新重复上面的步骤，再花费5时钟周期执行下一条指令，如此往复。这种执行方式有致命的缺点，例如当前执行的指令正在进行取指令阶段，那后面的译码、执行、访存、写回模块都必须等待，一直等待到执行到自己这一步才开始工作，工作完之后继续进入下一轮等待。这造成了极大的资源浪费。因此流水线技术应运而生，流水线技术就是将上面划分出来的五个模块各自独立运行，具体原理见下图。
由图中可以看出，在第5个时钟周期之后，五个模块全部同时开始进入工作，不再有长时间的空闲等待的现象，由原来每5个时钟周期执行完成一条指令提升为每个时钟周期执行完一条指令（上图中的第5个时钟周期之后）（假设前提是每个步骤都能在一个时钟周期内完成），极大的提高了各个模块资源的利用率。下图为经典五级流水线结构图：
前面假设的是每个步骤都能在一个时钟周期内完成，这种假设是为了方便阐述流水线的思想，但是这并不是实际情况，实际情况是每个步骤可能需要的时间不同，比如
在这种各个阶段所需要的时间不同的情况下，耗时最长的阶段决定了CPU的执行速度，及上图的流水线中执行一条指令的时常为11ns（可以思考一下为什么？）。
以上的设计并非是最好的设计，我们可以对这个流水线进行优化，优化方向有两个：1、为功耗优化 2、为性能优化
（1）为功耗优化，可以进行流水及合并，例如
将执行流水段和访存流水段合并，合并后执行一条指令的时长为15ns，相较于原先的11ns变慢了一点，但是却可以节省了硬件资源，降低了功耗。
（2）为性能优化，可以拆分流水线，例如
拆分流水线后缩短的指令执行的时间，但是流水级数的增加也会带来很多问题，会消耗更多的硬件资源，更大的功耗，更复杂的控制逻辑。
未完待续。。。。
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