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原创 实现同步FIFO的两种方式(Verilog)
FIFO 是一种先进先出的数据缓存器,一般用在隔离两边读写带宽不一致,或者位宽不一样的地方。在 FPGA 设计,使用 FIFO 一般有两个方法,第一个方法是直接调用官方的 FIFO IP,另外一个方法是自己设计 FIFO 控制逻辑。FIFO 包括同步 FIFO 和异步 FIFO 两种。同步 FIFO 有一个时钟信号,读和写逻辑全部使用这一个时钟信号。异步 FIFO 有两个时钟信号,读和写逻辑用的各自的读写时钟。FIFO 与 RAM 的区别是没有外部读写地址线;
2023-07-26 11:10:42
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原创 【Verilog语法+:和-:】
base起始位可以是变量,width的宽度必须是常量,即vect[idx+:cnt]不符合语法标准,vect[idx+:4]或vect[idx-:4]才符合。
2023-07-19 11:27:12
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原创 【 序列检测总结】
如果是可重叠序列检测,移位寄存器的方式代码更加简洁,面积也更小。如果是不可重叠序列检测,三段式状态机的实现方式思路更加清晰,不易出错。对于不可重叠序列检测,如果采用移位寄存器的方式,要保证每检测到一次序列后,都需要将移位寄存器左移四位以后,再进行下一次的检测和判断。(需要不断更新计数器)
2023-07-18 21:56:41
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转载 2021-04-08
matlab:把cell中的某个元素删去>> mn{1}=[1 2]mn =[1x2 double]>> mn{2}=[1 2 3]mn =[1x2 double] [1x3 double]>> mn{3}=[1 2 3 4]mn =[1x2 double] [1x3 double] [1x4 double]>> mn(1)=[] %关键在这里,用的是小...
2021-04-08 22:23:46
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转载 2021-04-07
模拟波束成形与数字波束成形区别https://ma-mimo.ellintech.se/2017/10/03/what-is-the-difference-between-beamforming-and-precoding/
2021-04-07 14:40:43
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空空如也
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