CPU缓存架构+Disruptor内存队列

最新推荐文章于 2024-08-30 17:00:00 发布
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分类专栏： 多线程高并发专题 深入学习总结笔记 文章标签： 缓存 架构 java
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CPU缓存架构+Disruptor内存队列

CPU缓存架构

介绍

cpu与内存的交互数据之间，有一个高速缓存层。有些处理器有3层缓冲，有些处理器有4层缓存

当下CPU都是有多核，每核cpu都有一份自己的高速缓存

内存中的数据读取到高速缓存中每次读取的数据至少是一次缓存行64字节

在这里插入图片描述



缓存一致性问题

多个cpu将数据赋值到高速缓存中，再进行更新操作，先是修改的缓存中的数据，然后在刷新回主内存，那么此时就有缓存一致性问题。

多个cpu缓存中的数据与主存中不一致，如果都直接刷新回主内存那么就肯定会出现丢失更新的问题。

解决缓存一致性问题的方案：

  • CAS原子指令
  • 总线锁定。上图中数据的传输是使用总线，直接给总线加一把锁。这种方式对性能较低
  • 缓存锁定。利用缓存一致性协议实现


缓存一致性协议

缓存一致性协议是一种用于确保处理器缓存中的数据和主存中的数据一致的机制。它的实现是基于总线窥探实现的

总线窥探

总线窥探是缓存中的一致性控制器监视总线事务的一种方案。在计算机中，数据通过总线在处理器和内存之间传递。每次处理器和内存之间的数据传递都是通过一系列步骤来完成的&

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胡尚
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并发编程-CPU缓存架构详解 & Disruptor的高性能设计方案
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10-31 615
CPU高 速缓存可以分为一级缓存，二级缓存，部分高端CPU还具有三级缓存，每一级缓存中所储存的全部数 据都是下一级缓存的一部分，这三种缓存的技术难度和制造成本是相对递减的，所以其容量也是相对递增的。如果缓存中没有该数据的副本，则会发出一 个缓存不命中（miss）请求，从主内存中获取该数据的副本，并将该数据的副本存储到自己的缓存 中。不能被缓存在处理器内部的数据通常指的是不可缓存的设备内存（如显存、网络接口卡的缓存 等），这些设备内存一般不受缓存一致性协议的管辖，处理器无法将其缓存到自己的缓存行中。
false sharing
chivalry
11-17 1063
http://ifeve.com/disruptor-cacheline-padding/ 我喜欢在LMAX工作的原因之一是，在这里工作让我明白从大学和A Level Computing所学的东西实际上还是有意义的。做为一个开发者你可以逃避不去了解CPU，数据结构或者大O符号 —— 而我用了10年的职业生涯来忘记这些东西。但是现在看来，如果你知道这些知识并应用它，你能写出一些
剖析Disruptor:为什么会这么快？（二）神奇的缓存行填充
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disruptor --神奇的缓存行填充1
青箫的博客
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Disruptor十三问之三CPU缓存行填充
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03-24 145
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变个魔术
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备注，现在已经进入多核时代了，考虑问题要考虑多核啊 volatile关键字 当变量被某个线程A修改值之后，其它线程比如B若读取此变量的话，立刻可以看到原来线程A修改后的值 注：普通变量与volatile变量的区别是volatile的特殊规则保证了新值能立即同步到主内存，以及每次使用前可以立即从内存刷新，即一个线程修改了某个变量的值，其它线程读取的话肯定能看到新的值； 普通变量...
@Contended / Disruptor 缓存行占满注解
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目录 缓存行与伪共享 Disruptor 缓存行填充 @Contended 速度测试 存储设备往往是速度越快价格越昂贵，速度越快价格越低廉。在计算机中，CPU 的速度远高于主存的速度，而主存的速度又远高于磁盘的速度。为了解决不同存储部件的速度不对等问题，让高速设备充分发挥性能，引入了多级缓存机制。 为了解决内存和 CPU 的速度不匹配问题，相继引入了 L1 Cache、L2 Cache、L3 Cache，数字越小，容量越小，速度越快，位置越接近 CPU。 图片 现在的 CPU 都是由多个
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缓存行： 缓存行越大，局部性空间效率越高，但读取时间慢 缓存行越小，局部性空间效率越低，但读取时间快 取折中值目前是 64字节 缓存行对齐：对于有些特别敏感的数字，会存在线程高竞争的访问，为了保证不发生伪共享，可以使用缓存行对齐的编程方式，大概会提升1/3的效率。 JDK7: 采用long padding 提高效率 JDK8：加入@Contended注解，需要配置JVM参数： -XX:ResrtictContended 原理： 把两个不同的参数放在不同的缓存行内，从而提高线程..
disruptor --神奇的缓存行填充2
青箫的博客
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解决方案－神奇的缓存行填充你会看到Disruptor消除这个问题，至少对于缓存行大小是64字节或更少的处理器架构来说是这样的（译注：有可能处理器的缓存行是128字节，那么使用64字节填充还是会存在伪共享问题），通过增加补全来确保ring buffer的序列号不会和其他东西同时存在于一个缓存行中。1 public long p1, p2, p3, p4, p5, p6, p7; // cache l
CPU缓存架构解析与高性能内存队列Disruptor实战
本资源是一组关于Java多线程、并发和高性能编程的教程资料，包含CPU缓存架构的深入解析以及Disruptor高性能内存队列的实战应用。讲解了线程池ThreadPoolExecutor的底层原理，ForkJoinPool的工作原理，并发可见性、...
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