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RSS订阅原创 fpga有限状态机知识点总结
状态机( State Machine )有限状态机(Finite: StateMachine，简称FSM)在有限个状态之间按一定规律转换的时序电路。状态寄存器由一组触发器组成，用来记忆状态机当前所处的状态，状态的改变只发生在时钟的跳变沿。状态是否改变、如何改变，取决于组合逻辑F的输出，F是当前状态和输入信号的函数。状态机的输出是由输出组合逻辑G提供的，G也是当前状态和输入信号的函...
2020-05-04 13:51:09
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原创 fpga 语法
结构语句initial和alwaysinitial语句它在模块中只执行一次。它常用于测试文件的编写，用来产生仿真测试信号(激励信号)，或者用于对存储器变量赋初值。always语句一直在不断地重复活动。但是只有和一定的时间控制结合在一起才有作用。例//给输入信号初始值initial beginsys clk <=1'b0 ;sys rst n <=1 'b0 ;t...
2020-05-04 11:03:21
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原创 FPGA模块调用
功能定义部分有三种方法1、assign语句描述组合逻辑2、always语句描述组合/时序逻辑:3、例化实例元件如: and #2 u1(q,a,b);上述三种逻辑功能是并行的注意:在的ways块中， 逻辑是顺序执行的。而多个always块之间是并行的。模块的调用（类似于C语言里面函数的调用）也叫作例化在模块调用时，信号通过模块端口在模块之间传递。例子modulel ti...
2020-05-04 10:14:04
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空空如也
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