Vivado之MMCM IP核

一、MMCM原理

图1 MMCM原理框图

       如图1所示,MMCM基于压控振荡器工作机制完成时钟频率输出。

       鉴相器PFD对输入时钟CLKIN1/CLKIN2和反馈时钟CLKFBOUTB/CLKFBf进行比较,实时控制电荷泵CP和环路滤波LF产生相应的电压给压控振荡器VCO,从而实现比较准确的时钟频率输出。

二、常见的MMCM设计框图

图2 MMCM设计框图

       如图2所示,晶振输出引脚连接至FPGA的MRCC或SRCC引脚;经BUFG缓存后,输出至MMCM IP核;图2中MMCM1与MMCM2级联是为了输出更精确的时钟频率,若一级可以满足要求,直接使用MMCM1的输出时钟频率即可。

三、MMCM IP核应用

       在Vivado中选择Clocking Wizard IP核,设置图3、图4两页内容即可,点击“OK”后生成IP核。之后对其进行例化后,即可将输出时钟作为整个设计的工作时钟。

       reset为MMCM复位输入,高电平复位;

       clk_in1为MMCM时钟输入;

       clk_out1、clk_out2为MMCM输出时钟;

       locked为时钟锁定输出,当MMCM输出时钟稳定后,locked由低电平变为高电平;该输出脚可以作为整个设计的全局复位使用。

图3 MMCM设置一

图4 MMCM设置二

四、注意事项

       1、当晶振时钟不足以直接输出想要的时钟频率时,可以先输出一个中间的小数时钟频率,再级联输出预想的时钟频率,如图2所示;

       2、当一个MMCM输出多个时钟频率时,由于VCO频率需要兼顾各个时钟频率,第二个或者第三个时钟频率可能达不到预想的时钟频率要求,此时可以增加MMCM单独输出或者调整时钟输入频率。

Vivado中,MMCM(Mixed-Mode Clock Manager)和PLL(Phase-Locked Loop)是用来生成、分频和调整时钟信号的重要IPMMCM是PLL的超集,具有比PLL更强大的相移功能,主要用于驱动器件逻辑的时钟。而PLL主要用于为内存接口生成所需的时钟信号,但也可以用作额外的时钟资源,与器件逻辑连接。 在Vivado中,使用Clocking Wizard IP来配置MMCM和PLL的参数。在"MMCM Setting"选项卡中,Vivado会根据用户输入的时钟需求自动配置参数,并进行最优化的配置。在绝大多数情况下,这些参数都不需要用户进行更改,因此建议保持默认设置。因此,根据具体的应用需求,可以选择使用MMCM或PLL来生成和管理时钟信号。<span class="em">1</span><span class="em">2</span><span class="em">3</span> #### 引用[.reference_title] - *1* *2* [Vivado18.3-IP-MMCM/PLL 学习笔记](https://blog.csdn.net/weixin_42151221/article/details/103351855)[target="_blank" data-report-click={"spm":"1018.2226.3001.9630","extra":{"utm_source":"vip_chatgpt_common_search_pc_result","utm_medium":"distribute.pc_search_result.none-task-cask-2~all~insert_cask~default-1-null.142^v92^chatsearchT3_1"}}] [.reference_item style="max-width: 50%"] - *3* [时钟IP配置中PLL和MMCM的区别](https://blog.csdn.net/qq_40528849/article/details/120819873)[target="_blank" data-report-click={"spm":"1018.2226.3001.9630","extra":{"utm_source":"vip_chatgpt_common_search_pc_result","utm_medium":"distribute.pc_search_result.none-task-cask-2~all~insert_cask~default-1-null.142^v92^chatsearchT3_1"}}] [.reference_item style="max-width: 50%"] [ .reference_list ]
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