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RSS订阅原创 FPGA UART串口设计与上板
最后将比特流进行烧录，使用micro USB连接uart端口，在Microsoft Store下载了一个串口调试助手，然后需要去下载一个驱动，就可以进行数据的收发。IP核为一个分频模块，将FPGA的200M差分信号晶振分频为5M的时钟信号（主要为了后续项目，可以直接使用差分信号或者任意分频频率）。对于RX接收模块，使用串口调试工具发送数据，FPGA接收数据后，根据低4位数据点亮FPGA上的LED灯。对于TX发送模块，为了简单测试模块的功能，在复位后简单打拍几下，将测试数据发送到串口调试工具上。
2024-03-31 00:07:23
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原创 异步FIFO verilog设计与仿真
设计总共包含五个文件，分别是参数定义文件parameter.v，跨时钟同步模块synchronization.v，双口存储模块dual_ram.v，顶层模块fifo_asyn.v和仿真文件fifo_tb.v。
2024-03-07 01:47:42
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空空如也
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