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转载块RAM和分布式RAM的区别

来源：https://www.eefocus.com/zpshao/blog/11-01/201525_d33fc.html

2020-03-24 21:14:03 3039

原创 Vivado HLS 中接口和端口的区别

接口对应的是资源，端口对应的是协议和服务，端口只能按照固定的协议提供服务，接口必须通过端口才能实现资源调用在通常的RTL设计中，对于输入和输出操作，在设计接口时，必须通过端口来实现，而这种设计通常需要使用特定的I/O协议。对于Vivado HLS，当顶级函数被综合时，函数的参数被综合为RTL端口，这个过程就称为接口的综合，而这个过程就需要使用I/O协议。...

2020-03-16 18:49:04 651

翻译 Vivado HLS接口协议（一）接口综合实例分析------时钟、复位端口，块级、端口级接口协议

管理接口在基于C的设计中，所有输入和输出操作都在零时间内通过形参函数执行，而在RTL设计中，这些输入和输出操作必须通过设计接口中的端口执行，并且通常使用特定的I / O协议进行操作Vivado HLS支持两种解决方案用于指定所使用的I / O协议类型：1）接口综合，其中端口接口基于有效的行业标准接口创建2）手动接口规范，可在输入源代码中明确描述接口行为，允许使用任意I / O协议。其中I...

2020-03-16 13:16:56 1789

原创 Vivado HLS 高级综合编码样式（一）不支持的C架构、系统调用、动态内存使用、递归函数、标准模板库

## 不支持的C架构要综合：1）C 函数必须包含设计的全部功能2）系统调用操作系统无法执行任何功能3）C 构造必须具有固定或有界大小4）这些结构的实现必须是明确的系统调用1.Vivado HLS忽略仅显示数据且对算法执行没有影响的常用系统调用，通常，这些对系统的调用不能被综合，应该在综合之前从函数中删除，如 printf、 fprintf、getc()、time()、sleep()。...

2020-03-03 21:20:29 1790 2

原创 Verilog HDL 中wire和reg的区别以及模块调用时信号类型的确定方法

wire和reg的区别reg相当于存储单元，wire相当于物理连线。reg保持最后一次的赋值，而wire需要持续的驱动。wire使用在连续赋值语句assign中，reg使用在过程赋值语句中（always、测试文件中的initial）。（除此之外，元件实例化时必须使用wire类型）wire若无驱动器连接，其值为z，reg默认初始值为不定值xwire表示直通，没有逻辑性，即输入有变化，输出...

2020-03-01 11:34:07 3062

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原创 Verilog HDL 中wire和reg的区别 以及 模块调用时信号类型的确定方法

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