实验2 存储器设计与实现【计算机组成原理】

本次实验旨在掌握单端口RAM和ROM的原理及设计,涉及32位数据的读写操作。通过使用Verilog HDL在Modelsim和ISE/Vivado环境下,设计了深度为1K、位宽32 bit的单端口ROM和RAM,并完成了仿真测试。实验加强了对FPGA开发工具和测试代码编写的理解。

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实验2 存储器设计与实现

一、实验目的

  1. 掌握单端口RAM和ROM原理和设计方法。
  2. 掌握32位数据的读出和写入方法。
  3. 掌握ModelSim和ISE\Vivado工具软件。
  4. 掌握基本的测试代码编写和FPGA开发板使用方法。

二、实验环境

  1. 装有ModelSim和ISE\Vivado的计算机。
  2. Sword\Basys3\EGo1实验系统。

三、实验原理

片内存储器分为RAM和ROM两大类。RAM是随机存储器,存储单元的内容可按需随意取出或存入。这种存储器在断电后将丢失所有数据,因此一般用来存储一些短时间内使用的程序和数据。

ROM即只读存储器,是一种只能读出事先存储的数据的存储器,其特性是存入的数据无法改变。也就是说,这种存储器只能读不能写。由于ROM在断电之后数据不会丢失,所以通常用在不需经常变更的电子资料。
通常情况下,存储器系统是按照字节(Byte)编址,但CPU访问时,通常按照字(Word)读取,因此地址就有字节地址和字地址的区别。以32位处理器为例,如图2所示。

图2 32位处理器字节编址与字地址示意图

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