FPGA
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使用Quartus以及Modelsim讲解FPGA Altera的操作使用方法
翎智骁
这个作者很懒,什么都没留下…
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【FPGA】Quartus项目工程创建以及联合Modelsim进行仿真(FPGA项目创建与仿真)
然后按住Ctrl+N或者左上角 文件-New 进行verilog HDL 文件添加,选择verilog HDL File选项,点击ok确认。这里我们不用项目模板也没有要添加的文件,所以一直点击next来到设备选择,我这里用的是Cyclone IV系列的,选好设备后点击next。接着我们打开该测试模板进行编写,按住Ctrl+O选择文件,将文件类型改成all files,并点击simulation文件夹。接下来在打开的文件中编写要实现的模块的代码,要注意的是,然后选中以下区域,将其替换成下面代码块中的代码。原创 2024-03-08 13:49:23 · 2054 阅读 · 1 评论 -
【FPGA】组合逻辑电路三种建模方式(Verilog HDL 门级建模、Verilog HDL 数据流建模、组合电路行为级建模)
可以理解为对逻辑电路中各个门依次进行描述二建模成组合逻辑电路。原创 2024-03-10 11:41:51 · 1540 阅读 · 1 评论