软件设计师中级-Cache相关题目

【2020年下半年】在程序执行过程中,高速缓存(Cache)与主存间的地址映射由(1)。
(1) A.操作系统进行管理 B.存储管理软件进行管理
C.程序员自行安排 D.硬件自动完成
答案:D
解析:
考点:计算机系统知识–存储系统–存储器的层次结构
Cache与主存之间的交互功能全部由硬件实现,而主存与辅存之间的交互功能可由硬件与软件结合起来完成。

【2019年下半年】在cpu内外常需设置多级高速缓存cache,主要目的是(1)。
(1) A.扩大主存的存储容量
B.提高cpu访问主存数据或指令的效率
C.扩大存储系统的存量
D.提高cpu访问内外存储器的速度
答案:B
解析:Cache并不能扩大存储,CPU不会直接访问外存,访问顺序为,将外存数据放入内存,CPU通过访问内存来读取数据。

【2017下半年】在程序执行过程中,Cache与主存的地址映射是由(2)完成的。
(2)A.操作系统 B.程序员调度 C.硬件自动 D.用户软件
答案:C

【2017上半年】以下关于Cache(高速缓冲存储器)的叙述中,不正确的是(6)。
(6)A.Cache的设置扩大了主存的容量
B.Cache的内容是主存部分内容的拷贝
C.Cache的命中率并不随其容量增大线性地提高
D.Cache位于主存与CPU之间
答案:A
【2016下半年】以下关于Cache与主存间地址映射的叙述中,正确的是(6)。
(6) A.操作系统负责管理Cache与主存之间的地址映射
B.程序员需要通过编程来处理Cache与主存之间的地址映射
C.应用软件对Cache与主存之间的地址映射进行调度
D.由硬件自动完成Cache与主存之间的地址映射
答案:D

Cache工作于CPU与内存之间
在这里插入图片描述
在这里插入图片描述
Cache-概念
1.Cache的功能:提高CPU数据输入输出的速率,突破冯●诺依曼瓶颈,即CPU与存储
系统间数据传送带宽限制。
2.在计算机的存储系统体系中,Cache是 访问速度最快的层次。
3.使用Cache改善系统性能的依据是程序的局部性原理。
例题:
在这里插入图片描述
假如t1=1ns,t2=1ms=1000ns(ns–纳秒,ms–毫秒),h=95%
命中率:读取Cache,能够获取到需要数据的概率
未命中率:
全部使用Cache:1ns(很快)
不使用Cache:1000ns(很慢)
使用Cache加主存:
t3=1ns*95%+5%*1000ns=50.95ns(速度大概提高了20倍)

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软考中级软件设计师学习笔记 World版本 下载后可直接打印作为2020年上半年考试的复习资料用 1.CPU 的功能的功能:程序控制、操作控制、时间控制、数据处理。 2.计算机系统组成示意图计算机系统组成示意图: 3.数据表示数据表示:原码、反码、补码、移码。(0 为正,1 为负) 4.移码移码:如果机器字长为 N,偏移量为 2N-1,则[X]移=2N-1+[X]补(X 为纯整数)。[X]移=1+X(X为纯小数)。 5.IEEE754:符号位(1 位,0 正 1 负)+阶码(8 位,+127)+尾数(23 位,小数点在最高位之后,随后省略最高位)。 6.浮点数加减浮点数加减:0 操作数检查,对阶操作(小阶变大阶),尾数加减(阶码用双符号位,尾数用单符号位),结果规格化,舍入处理(判定溢出)。 7.常用校验码常用校验码:奇偶校验码(只能检错)、海明码(纠错加检错)、循环冗余校验码(CRC)。 8.计算机体系结构分类计算机体系结构分类:单处理系统,并行处理与多处理系统,分布式处理系统。 9.指令集的发展:CISC(复杂指令集计算机):增强原有指令的功能,用更为复杂的新指令取而代之;RISC(精简指令集计算机):减少指令总数简化指令功能,优化编译降低复杂度。 10.指令控制方式指令控制方式:顺序方式,重叠方式,流水方式。 11.RISC 中的流水线技术中的流水线技术:超流水线技术,超标量技术,超长指令字技术。 12.并发性的解决并发性的解决:阵列处理机,并行处理机,多处理机。 13.主存与 cache 地址映射方式地址映射方式:全相联映射-将主存一个块的地址与内容一起存入 cache 中,计算机 硬件系统 软件系统 输入设备 输出设备 存储器 运算器 控制器 内存储器 外存储器 算术逻辑单元ALU 累加寄存器AC 数据缓冲寄存器DR 状态条件寄存器PSW 指令寄存器IR 程序计数器PC 地址寄存器AR 指令译码器ID 中央处理单元 CPU 寄存器组 控制总线 ROM RAM

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