candence pcb走线等长_【加精】Allegro中走线等长设置进阶

最新推荐文章于 2024-05-30 11:37:31 发布
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文章标签： candence pcb走线等长
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本文链接：https://blog.csdn.net/weixin_30950075/article/details/112809384
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该博客介绍了在Allegro中进行高级的走线等长设置，特别是针对Xnet的概念和应用。在高速电路设计中，走线等长至关重要。文章详细讲解如何将连续的无源元件连接的net组合成Xnet，并通过Xnet实现更灵活的等长调整，以解决不同部分走线空间不一致的问题，降低Layout工程师的绕线难度。
摘要由CSDN通过智能技术生成

Allegro

中走线等长设置进阶

在高速电路设计中

,

走线的等长显得越来越重要

,

因此设置等长这问题也就产生了

,

对于简单走线等长在以前文档中都有涉

及这里不再复述了

,

下面内容将给大家介绍一下有关

Xnet

等长的设置问题

,

如现在主板

DDR, IDE

等部分设等长问题

.

注意

:

以下设置方法不是公板方式

,

是我自己摸索的设置方法

,

所以大家不必效仿

,

仅供参考

!

如果大家有任何其它或简单方法也请分享一下经验

!

在这之前首先介绍一下一个新个概念

Xnet,

见下图

:

我们把连续的几段由无源元件

(

如电阻

,

电容或电感

)

连接的

net

合称为一段

Xnet.

大家知道

Allegro

中有两个常用的走线长度设置

,PROPAGATION_DELAY, RELATIVE_ PROPAGATION_DELAY

都只能

针对同一

Net

设置

,

下面是一个具体案例

:

现在要求

U1

到

U2

的走线</

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無酒
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