cmos模拟集成电路设计 艾伦 课件_CMOS版图视频课程-第十二讲-Mentor Calibre版图验证工具 -现在五一有优惠...

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Mentor Calibre版图验证工具概述

Mentor Calibre版图验证工具调用

Mentor Calibre DRC验证

Mentor Calibre LVS验证

Mentor Calibre寄生参数提取(PEX)

随着超大规模集成电路芯片集成度的不断提高，需要进行验证的项目也越来越多。版图物理验证在集成电路消除错误、降低设计成本及设计风险方面起着非常重要的作用。

版图物理验证主要包括设计规则检查(DRC)、电学规则检查(ERC)以及版图与电路图一致性检查(LVS)三个主要部分。nn业界公认的EDA设计软件提供商都提供版图物理验证工具，如Cadence公司的Assura、Synopsys公司的Hercules以及Mentor公司的Calibre。在这几种工具中，Mentor Calibre由于具有较好的交互界面、快速的验证算法以及准确的错误定位，在集成电路物理验证上具有较高的占有率。

主讲陈博士实战经验：

陈博士，副教授，在微电子学与固体电子学领域多年理论和实战经验，在高性能模拟/混合信号集成电路设计(可编程增益放大器、自动增益控制环路、高性能模数/数模转换器等,低功耗、高精度、低噪声传感器接口及信号处理电路设计，高可靠加固标准单元库设计）领域有多年深耕经验，具有扎实的理论基础，丰富的实战经验，累计发表论文60余篇，授权发明专利11项，出版论著及译著8部。实战经验方面，陈博士在SMIC 55/90/130/180/350nm、TSMC 180/350nm以及UMC180nm等工艺节点上完成了10/12bit1MHz SAR ADC、12bit 100MHz Pipelined ADC、16/18bit 500kHzSigma-Delta ADC、热电堆模拟前端、生物传感节点、16位MCU、语音信号SoC等十余个IP的流片，具有丰富的设计和测试经验。

未来发展战略：会以微信公众号“集成电路设计那些事儿”（英文名字：“IC_Design_Story”）为主体，依托各类一线工程师，科学家，硕博士，陆续发布集成电路设计类实战视频课程，未来计划开展：模拟ADC实战设计，基于Verilog的FPGA设计，基于Cadence Allegro的PCB设计，通信算法类（软件无线电，数字功放预失真DPD）等，该套视频力图从项目实战出发，解决初学者无人带，入门难，摸不清的难题，相信在课程实战的辅导下，公众号能与大家共同成长、提高，如大家有兴趣，可以长期关注。