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本期加油站解析题目来源华为硬件岗,共4道单选题,涉及知识点包含:信号不失真的条件、数据几种传输方式、保持时间、二进制十进制互转。
NO.1信号无失真传输的条件是:
A 相位特性是一通过原点的直线
B 幅频特性等于常数,相位特性是一通过原点的直线
C 幅频特性是一通过原点的直线,相位特性等于常数
D 幅频特性等于常数
解析:无失真传输两个特性。
无失真传输是指只有幅度的大小与出现的时间先后不同,波形上没有变化的系统的输出信号或输入信号。
失真传输是主要传输特性通常可以用其幅频曲线和相频曲线来描述。无失真传输要求振幅特性与频率无关,即其振幅频率特性曲线是一条直线;要求其相位特性是一条通过原点的直线,或者等效地要求其传输群时延与频率无关。
因此答案为B。
NO.2主机与设备传输数据时,采用哪种方式CPU的效率最高
A 中断方式
B DMA方式
C 软件查询方式
D 程序查询方式
解析:不同传输方式的优缺点比较。
中断方式:检查条件不占CPU时间,但当满足条件时,比如数据缓冲区存满,就会进入中断子程序,这时CPU就要进行中断处理,所以处理需占CPU时间。
DMA的英文拼写是“Direct Memory Access”,是一种不经过CPU而直接与数据交换数据模式。在DMA方式下,CPU只须向DMA控制器下达指令,让DMA控制器来处理数的传送,数据传送完毕再把信息反馈给CPU,这样就很大程度上减轻了CPU资源占有率。比如在一些示波器中,瞬时要处理很多数据,这时就会采用DMA的方式进行数据传输。
程序查询方式:程序直接控制方式,这是主机与外设间进行信息交换的最简单的方式,输入和输出完全是通过CPU执行程序来完成的。也是需要占用CPU时间。选项C的软件查询方式和程序查询方式同属一宗。
综上,DMA的方式会让CPU的效率最高,所以选择B。
NO.3有关保持时间tH描述正确的是()
A 指数据在时钟有效沿到来之后仍须稳定的时间
B 是指从时钟有效沿到输出数据稳定的时间
C 同一时钟通过不同路径到达不同触发器的延时之差
D 指数据在时钟有效沿到来前必须稳定的时间
解析:考察保持时间的定义。
在FPGA设计,有两个概念尤其重要,即建立时间和保持时间。同一个模块中常常是包含组合逻辑与时序逻辑,为了保证在这些逻辑的接口处数据能稳定的被处理,那么对建立时间与保持时间建立清晰的概念非常重要。如果不满足,很可能读取不到需要的数据,或者直接读到一个错误的数据。
建立时间(Setup Time):触发器的时钟信号上升沿到来之前,数据保持稳定不变的时间。
如果不满足建立时间要求,数据就不能被准时的打入触发器,只有在下一个时钟有效沿,数据才能被打入触发器,或者说,该数据就会被永久“跳过”而未被“采样”。
保持时间(Hold Time):触发器的时钟信号有效沿到来之后,数据保持稳定不变的时间(数据保持不变以便能够稳定读取,如果保持时间不满足的话,那么数据便不能被有效读取并转换为输出)。
所以本题考察的保持时间定义应该是A。
NO.4如果二进制数为11.101,那么对应的十进制数是:
A 3.625
B 3.75
C 3.5125
D 3.5
解析:二进制转换为十进制方法。
二进制数11.101转换为十进制时,分为两个部分转换:小数点前的11转换没有问题,即1*20+1*21=3;小数点后的101,转换为十进制应为:1*2-1+0*2-2+1*2-3=0.625。
所以二进制数11.101对应的十进制数是3.625,答案为A。
下期预告
下期会解析2道来自大疆FPGA逻辑岗的单选题,会做的同学,欢迎在文末留下答案哟。
4、假设时钟周期为T,寄存器时钟端到数据输出端的延迟为Tcq,时钟到第一级寄存器的时钟端的延迟为Tcd1,时钟到第二级寄存器时钟端的延迟为Tcd2,两级寄存器之间的组合逻辑延迟为Tpd,寄存器的建立时间为Tsetup,Tpd的最大延迟为( )。
A Tpd ≤ T - Tsetup - Tcq -(Tcd2 - Tcd1)
B Tpd ≤ T - Tsetup + Tcq -(Tcd2 - Tcd1)
C Tpd ≤ T - Tsetup + Tcq -(Tcd1 - Tcd2)
D Tpd ≤ T - Tsetup - Tcq -(Tcd1 - Tcd2)
5、以下是对Cache-主存-辅存三级存储系统中各级存储器的作用,速度,容量的描述,其中完全正确的是( )。
A 主存用于存放CPU正在执行的程序,速度慢,容量极大
B Cache用于存放CPU当前访问频繁的程序和数据,速度快,容量小
C 加大Cache的容量可以使主存储能够存放更多的程序和数据
D 辅存用存放需要联机保存但暂不执行的程序和数据,速度快,容量极大
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