数字IC前端设计
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亚稳态处理之两级同步和握手
亚稳态是指在设计的正常运行过程中,信号在一定时间内不能达到稳定的0或者1的现象。原创 2022-04-27 22:33:55 · 1422 阅读 · 0 评论 -
vcs后仿步骤
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verilog乘法器——基于Booth算法和Wallace树
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Verilog语法总结
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三段式状态机
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IC设计之——Verilog编码规范
Verilog编码规范原创 2020-06-30 23:27:00 · 381 阅读 · 0 评论