北华大学计算机组成原理考试题.doc
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内容要点:
非总线结构。写出取指周期的全部微操作。11.设某机主存容量为 16MB,Cache 的容量为 16KB。每字块有 8 个字,每个字32 位。设计一个四路组相联映像(即 Cache 每组内共有 4 个字块)的 Cache组织,要求:画出主存地址字段中各段的位数。12. 设 CPU 共有 16 根地址线,8 根数据线,并用 作访存控制信号,用MREQ作读写控制信号。现有下列存储芯片:WR/RAM:1K×4 位、2K×8 位、8K×8 位、16K×1 位、4K×4 位ROM:2K×8 位、8K×8 位、32K×8 位以及 74138 译码器和各种门电路(自定) ,画出 CPU 与存储器连接图。要求:(1)存储芯片地址空间分配为:0~8191 为系统程序区;8192~32767 为用户程序区。(2)合理选用上述存储芯片,说明各选几片?写出每片存储芯片的二进制地址范围。(3)详细画出存储芯片的片选逻辑。ROMAi 0CSDn0PD/rog RAMAi 0CSDn0OEWG12ABCBAY76Y08. 设 CPU 共有 16 根地址线,8 根数据线,并用 作为访存控制信号(低MREQ电平有效),用 作读写控制信号,现有下列存储芯片:WR/RAM:1K×4 位、4K×8 位ROM:2K×8 位、4K×8 位以及 74138 译码器和各种门电路(自定) ,画出 CPU 与存储器连接图。要求:(1)主存地址空间分配:8000H~87FFH 为系统程序区;8800H~8BFFH 为用户程序区。(2)合理选用上述存储芯片,说明各选几片?(3)详细画出存储芯片的片选逻辑。G12ABCBAY76Y09. 某机有五个中断源 L0、L1、L2、L3、L4,按中断响应的优先次序由高向低排序为 L0→L1→L2→L3→L4,现要求中断处理次序改为 L1→L3→L4→L0→L2,根据下示格式,写出各中断源的屏蔽字。中断源 屏蔽字0 1 2 3 4L0L1L2L3L410.设 CPU 内部的部件有:PC 、IR、MAR、MDR、ACC、ALU、CU,且采用G12ABCBAY76Y05. 某机有五个中断源 L1、L2、L3、L4、L5,按中断响应的优先次序由高向低排序为 L1→L2→L3→L4→L5,现要求中断处理次序改为 L1→L4→L5→L2→L3,根据下示格式,写出各中断源的屏蔽字。中断源 屏蔽字1 2 3 4 5L1L2L3L4L51 1 1 1 10 1 1 0 00 0 1 0 00 1 1 1 10 1 1 0 16.设 CPU 内部的部件有:PC 、IR、MAR、MDR、ACC、ALU、CU,且采用非总线结构。写出加法指令ADD X(X 为主存地址)在执行阶段所需的全部微操作。7.设某计算机采用直接映像 Cache,已知主存容量为 4MB,Cache 容量 4096B,字块长度为 8 个字(32 位/字) 。(1)画出反映主存与 Cache 映像关系的主存地址各字段分配框图,并说明每个字段的名称及位数。(2) 设 Cache 初态为空,若 CPU 依次从主存第 0,1,…,99 号单元读出 100个字(主存一次读出一个字) ,并重复按此序读 10 次,问命中率为多少? 3 程序用户程序t2.设 CPU 内部的部件有:PC 、IR、MAR、MDR、ACC、ALU、CU,且采用非总线结构。写出取数指令LDA X(X 为主存地址)在执行阶段所需的全部微操作。3.设某机主
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