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Flip-Flops
asynchronous (异步中CDC)
synchronous(同步时钟)
时钟上升沿到来后,会产生的 -
FSMs:有限状态机
在同步时钟中一般用状态机来进行控制
——structural view(FFs separate from combinational logic)
——behavioral view(synthesis of sequencers) -
Latch with Reset
第二个if没有else连接,所以当g=0时,Q锁存原来的值。 -
异步复位FF
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同步reset/set
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FF with Async & Sync Restn
7. N-bit shift register (N比特移位寄存器)
8. Counter 计数器
9. FSM
Mealy state machine: 输出取决于当前状态和当前输入
Moore: 输出只与现在状态有关
Moore Verilog FSM 三段式
判断转移状态的时候也能写成,next_state= (in)?`one1:`zero ;
Mealy Verilog FSM 三段式