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RSS订阅原创 FPGA复位设计总结
同步复位就是指复位信号只有在时钟上升沿到来时，才能有效。否则，无法完成对系统的复位工作。异步复位是指无论时钟沿是否到来，只要复位信号有效，就对系统进行复位。
2024-03-27 15:48:53
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原创 intel fpga lvds管脚约束报错问题记录
fpga工程师在硬件投板前必须要做锁io的步骤，这个是共识。最近在做Intel® Cyclone® 10 LP器件的开发，锁lvds输出管脚时发现报错。该提示十分明显，目前的管脚无法作为真LVDS管脚输出，如果一定要使用该管脚，约束需要换成LVDS_E_3R，另外板子上要加上电阻网络。进一步查资料发现该电阻网络在CycloneIV 和Cyclone® 10 LP是一样的。Cyclone® 10 LP硬件上验证有效。
2024-01-29 11:34:00
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原创 Signal tap 的各种用法
这次内容有点多，主要是方便我以后自己查看各个模式的含义，里面介绍的也是目前我最常用的。还有一些细节内容，想要详细了解的推荐查看手册，在公众号后台回复”Signal Tap手册“获取。Conditional模式经常使用，由于Signal Tap是要消耗资源的，比如CPU与FPGA通信，想要抓取这段时间内CPU发送的读写指令以及数据，如果使用常规模式，肯定完成不了的，这段时间内的无效数据可能会特别多，那么就可以使用Conditional模式外加自定义触发方式，抓取这段时间读写的所有指令及数据。
2024-01-20 20:00:26
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原创 FPGA的IO没有输入输出约束，导致IO外部电平只能为低
发现当单片机和fpga的IO共同连接拨码开关时，拨码开关的作用是置高或者低，当fpga这边没有输入输出约束，单片机读取拨码开关电平不正常，原因是fpga的IO在没有输入约束的情况下，影响了拨码开关对应IO的电平，是的拨码开关高低电平设置失效。
2023-08-21 20:27:09
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原创 单片机C语言开发，全局变量或静态变量被意外改写
最终找到原因，工程默认的栈大小设置的不合适。具体原因是demo大量使用结构体，栈的开销巨大，某个结构体的变量地址和该静态变量地址是冲突的。当栈大小设置成较大的值后，就不会出现地址冲突的情况。最近用单片机移植一个hdmi芯片的配置程序，将demo移植到工程中后，debug发现有个静态变量的值被意外改变，偶尔会程序没有根据程序设计意图而变化的值。我用的单片机是GD32f303VET6，原STACK设置的大小是0x200，修改成0x1400后正常。
2023-08-18 13:50:38
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原创 远程打开modelsim（matlab）失败，提示Unable to checkout a viewer license
远程打开modelsim（matlab）失败，提示Unable to checkout a viewer license
2022-11-07 14:53:55
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空空如也
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