MESI 缓存一致性协议引发的一些思考

最新推荐文章于 2022-02-17 17:58:59 发布
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某个下午偶尔间看到了 MESI 缓存一致性协议，引出了我不少相关的疑惑，写下此文记录

通过这篇文章你能了解到的知识

  1. MESI 协议是什么，解决了什么问题
  2. 指令重排 是什么，解决了什么问题
  3. 内存屏障 是什么，解决了什么
  4. MESI 与 并发同步的区别

MESI 缓存一致性协议

MESI 产生的前提

  • 多级缓存的出现
  • 多核 CPU 的出现

总之为了计算机的性能，现代计算机都具备上述两点的设计，下图为不同存储的 IO 速度对比

How to boost and scale PostgreSQL - from shared buffers to in-memory data grids - GridGain Systems

MESI 解决的问题

由于现在计算机都是多核 CPU 了，并且每一个 CPU 都有自己独立的缓存（如下图架构），这样就会有可能多个 cpu 操作同一份数据，导致各个 cpu 缓存中的同一份数据值不一致的情况。

CPU多级缓存架构- 知乎

MESI 的具体设

最低0.47元/天 解锁文章
小贺coding
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MESI--CPU缓存一致性协议浅谈
蓝天的博客
06-20 336
CPU为何要有高速缓存 现代处理器为了提高访问数据的效率，在每个CPU核心上都会有多级容量小，速度快的缓存（分别称之为L1 cache，L2 cache，多核心共享L3 cache等），用于缓存常用的数据。由于内存的速度要比CPU慢将近100倍，数据被修改时也只是先更新cache，并不是直接写回到主存中（CPU是不能直接跟内存进行通信的，CPU只对接cache，然后由cache对接主存），这样一来就造成了缓存中的数据与内存不一致。如果系统是单核处理器，所有线程看到的都是缓存中的最新数据，当然没有问题。但如
全面理解MESI缓存一致性协议
Me_xuan的博客
08-27 1069
MESI缓存一致性协议 多核CPU多级缓存一致性协议MESI 多核CPU的情况下有多个一级缓存，如何保证缓存内部数据的一致,不让系统数据混乱。这里就引出了一个一致性的协议MESI。 MESI协议缓存状态 MESI 是指4中状态的首字母。每个Cache line(缓存行（Cache line）:缓存存储数据的单元)。有4个状态，可用2个bit表示，它们分别是：Modidied(修改),Exclusive(独享)，Shared(共享)，Invalid(无效)。 注意： 对于M和E状态..
缓存一致性协议（MESI）
z69183787的专栏
05-21 1418
在目前主流的计算机中，cpu执行计算的主要流程如图所示： 数据加载的流程如下： 1.将程序和数据从硬盘加载到内存中 2.将程序和数据从内存加载到缓存中(目前多三级缓存，数据加载顺序:L3->L2->L1) 3.CPU将缓存中的数据加载到寄存器中，并进行运算 4.CPU会将数据刷新回缓存，并在一定的时间周期之后刷新回内存 缓存一致性协议发展背景 现在的CPU基本都是多核CPU，服务器更是提供了多CPU的支持，而每个核心也都有自己独立的缓存，当多个核心同时操作多个线程对...
MESI（缓存一致性协议）
热门推荐
xiaowenmu1的博客
04-30 4万+
现在的处理器都是多核处理器，并且每个核都带有多个缓存（指令缓存和数据缓存，见下图）。为什么需要缓存呢，这是因为CPU访问内存的速度比较慢，所以在CPU和内存之间加了个缓存以提高访问速度。既然每个核都有缓存，那么假设两个核或者多个核同时访问同一个变量时这些缓存是如何进行同步的呢（缓存细分为一个个缓存行），这就有了MESI协议。 缓存行的四个状态： MESI中每个缓存行都有四个状态，分别是E（...
并发编程之MESI缓存一致性协议
修理男爵的博客
01-10 675
MESI缓存一致性协议，用于解决多线程环境下的缓存一致性问题。 缓存一致性问题 在多处理器系统中，每个处理器都有自己的高速缓存，而它们又共享同一主内存。当多个处理器的运算任务都涉及同一块主内存区域时，将可能导致各自的缓存数据不一致的情况，如果真的发生这种情况，那同步回主内存时以谁的缓存数据为准呢？！这个就是缓存一致性问题。 为了解决一致性的问题，需要各个处理器访问缓存时都遵循一些协议，在读写时要根据协议来进行操作。主要使用的协议是：MESI缓存一致性协议。 缓存行(Cache line) CPU缓
5-3JMM-CPU缓存一致性协议MESI.mp4
12-21
5-3JMM-CPU缓存一致性协议MESI.mp4
并发研究之CPU缓存一致性协议(MESI)1
08-03
总的来说，MESI协议是保证多核CPU系统中缓存一致性的重要机制，确保了各处理器对共享数据的正确访问和更新，避免了数据冲突和不一致，从而维护了系统的正确性和稳定性。在设计和优化并发系统时，深入理解缓存一致性...
MESI缓存协议.docx
01-18
MESI缓存协议是一种多处理器缓存一致性协议，用于解决多核CPU中的缓存一致性问题。该协议定义了缓存行的四种状态：Modified（M）、Exclusive（E）、Shared（S）和Invalid（I），以确保缓存中的数据是一致的。 MESI...
15418-Cache-Simulator:我的15-418缓存一致性协议模拟器的存储库
05-03
综上所述，这个项目提供了一个用于模拟缓存一致性协议的工具，支持MSI、MESI和MOESI协议，并考虑了回写缓冲区和非原子总线事务等实际系统中的复杂情况。这样的模拟器对于理解和分析多处理器系统中的数据一致性问题...
ACP-HPC-HP的缓存一致性测试
最新发布
08-22
1. **缓存一致性协议**：不同的处理器架构可能采用不同的缓存一致性协议，如MESI（Modified、Exclusive、Shared、Invalidated）、MOESI、MESIF等。理解这些协议的工作原理对于设计和测试缓存一致性至关重要。 2. **...
CPU多级缓存-多核并发缓存架构解析
q865165648的博客
01-27 1286
CPU多级缓存 主内存（RAM）：也就是所谓的内存条，一般当数据写入电脑磁盘的时候需要先写入主内存，然后再写入磁盘。 系统主线：连接系统cpu和主内存的系统主线，就比如台式电脑连接主板上连接cpu和内存条的主线。 如下图所示最简单的高速缓存的配置，数据的读取和存储都经过高速缓存，CPU核心与高速缓存有一条特殊的快速通道；主存和高速缓存都连在系统总线上，这条总线还用于其他组件的通信。 高速缓...
MESI 协议
日常博客
10-18 493
目录 一：概念 二：详细说明 三：读写操作对应的状态转换 参考：用动图的方式，理解 CPU 缓存一致性协议！ 一：概念 MESI 协议其实是 4 个状态单词的开头字母缩写，分别是： Modified，已修改 Exclusive，独占 Shared，共享 Invalidated，已失效 这四个状态来标记 Cache Line 四个不同的状态。 二：详细说明 看上图，共分为三个部分： 第一部分，内存。显示内存地址和数据； ...
java共享缓存同步_java并发-多核CPU缓存架构及MESI缓存一致性协议
weixin_35990295的博客
02-25 224
摘要之前讲解过计算机理论模型：计算器、控制器、存储器、输入设备、输出设备。计算机硬件结构：cpu硬件结构(寄存器+多级缓存+总线接口)、总线(I/O总线、内存总线)、控制器(USB控制器，磁盘控制器)、存储器(总存储器、内存拓展槽)等；以及cpu内部结构(控制单元【指令存储器+指令计数器】、运算单元、存储单元)；既然讲解了cpu内部结构以及硬件结构；这一节主要讲解多核CPU缓存架构一节实现缓存一致...
CPU高速缓存（Cache Memory）
沮丧的南瓜
10-31 4059
文章目录CPU高速缓存多CPU多核缓存架构缓存一致性（Cache coherence）缓存一致性的要求写传播（Write Propagation）事务串行化（Transaction Serialization）一致性机制（Coherence mechanisms）总线仲裁机制总线锁定缓存锁定总线窥探(Bus Snooping)工作原理窥探协议类型一致性协议（Coherence protocol）MESI协议伪共享的问题linux下查看Cache Line大小避免伪共享方案 CPU高速缓存 CPU缓存即高速缓
MESI protocol
天上满是飞机
05-07 1394
http://en.wikipedia.org/wiki/MESI_protocol
缓存一致性协议（MESI）详解
我还可以
08-02 2930
缓存一致性协议是Java内存模型中的一种协议，具体如图所示： 缓存一致性协议分为四种状态： Modified（修改）：数据有效，数据被修改了，和内存中数据不一致，数据只存在于本Cache中。 Exclusive（独享）：数据有效，数据和内存中的数据一致，数据只存在于本Cache中。 Shared（共享）：数据有效，数据和内存中的数据一致，数据存在多个Cache中。 Invalid（无效）：数据无效，一旦数据被标记为无效，那效果就等同于它从来没被加载到缓存中。 缓存一致性协议工作流程/原理： CPU
缓存一致性协议-MESI
m0_38017860的博客
02-17 2917
背景带有高速缓存的CPU执行计算的流程程序以及数据被加载到主内存指令和数据被加载到CPU的高速缓存CPU执行指令，把结果写到高速缓存高速缓存中的数据写回主内存高速缓存的数据结构高速缓存的底层数据结构其实是一个拉链散列表的结构，就是有很多的bucket，每个bucket挂了很多的cache entry，每个 cache entry 由三个部分组成：tag 、 cache line 、 flagcache line ：缓存的数据，可以包含多个变量的值tag ：指向了这个缓存数据在主内存的数据的地址flag ：标
4.什么是MESI缓存一致性协议？怎么解决并发的可见性问题？
chenzengnian123的博客
01-07 1712
mesi缓存一致性协议是什么？mesi缓存一致性协议怎么解决可见性问题？
Manycore处理器的可扩展缓存一致性协议：L1缓存的混合写入策略
"这篇论文由刘浩撰写，探讨了多核处理器中的一种可扩展缓存一致性协议，专注于在共享地址空间的Manycore处理器环境下的应用。论文提到了现有的多核处理器，如Intel或AMD，通常采用MESI或MOESI协议，这些协议依赖于...

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