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原创 【芯片设计】verilog总结

参考资料。

2024-08-28 16:29:48 241

原创 UVM验证平台

了解UVM后觉得其本质是一个框架,就像pytorch对于深度学习,以及其他高级语言在特定需求下的一种框架。UVM就是SV在IC验证中的一种框架。不用UVM也能完成验证功能,只是复用性和便捷性不如用UVM的情况。对于UVM来说其强大的复用性决定它必定是面向对象的所以它的封装都很规范。一个验证平台大致分为sequencer、driver、monitor、reference model、scoreboard。大致结构如下图所示。这次刚看完UVM白皮书第二章的内容,大致了解了一下UVM的框架,做个简单的总结。

2024-08-28 15:30:37 130

空空如也

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