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RSS订阅原创 以太网接口
speedis10100:当内核工作于 10 Mbps 或 100 Mbps 速率时，此输出信号被置为有效。其值来源于 MAC 速度配置寄存器的位 [13:12]。speedis100: 当IP工作于 100 Mbps 速率时，此输出信号被置为有效。// mac_speed[1:0] = 2'b01: 强制100 Mbps模式。// mac_speed[1:0] = 2'b10: 强制1000 Mbps模式。// mac_speed[1:0] = 2'b00: 强制10 Mbps模式。
2025-12-12 18:13:53
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原创 PL与PS交互
ram_clk为输出信号，上述步骤将信号归类到‘Clock and Reset Signal’后，右键选中信号'edit interface ' ,在‘parameters’中增加名为‘FREQ_HZ’的参数即可。创建的输出时钟未归入‘Clock and Reset Signal’分类中，在创建的interface参数名中选中报错警告信号右键 'Associate Clocks....'即可。ip封装报错（环境vivado_2017.4 ）
2025-12-11 11:41:25
117
空空如也
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