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用的SMIC的Memory compiler生成SRAM IP，输出的库文件只有lib形式的，但是想添加到DC里面的link_library又只能是db形式。
2024-03-25 10:57:48
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原创 实现可综合的verilog代码
首次尝试自己设计硅转接板中的有源电路，这次是比较简单的SRAM，memory IP用SMIC memory compiler生成，周围写了转QSPI协议的电路来减少IO数量很多代码vcs能过，verdi里面的波形也符合预期，但是喂给design compiler时却提示错误，例如提示always块里面if后面不能加复杂判断将if后面改为简单判断就可以通过了。常写代码的朋友还给我发了以下经验参考，提前注意可以避免一些错误：综合问题（针对verilog）A：可综合与不可综合语句汇总：（1）所有综合
2024-03-25 10:05:28
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空空如也
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