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RSS订阅原创 FPGA篮球计分设计
消抖模块module key_module( //输入端口 clk,rst_n,KEY, //输出端口 key_out); //---------------------------------------------------------------------------//-- 外部端口声明//---------------------------------------------------------------------------...
2021-11-11 09:12:39
732
原创 七人表决器
module PRJ #( parameter SEG_0 = 8'b0011_1111, SEG_1 = 8'b0000_0110,SEG_2 = 8'b0101_1011, SEG_3 = 8'b0100_1111,SEG_4 = 8'b0110_0110, SEG_5 = 8'b0110_1101, SEG_6 = 8'b0111_1101, SEG_7 = 8'b0000_0111, parameter IDLE = 8'b0000_0000 ...
2021-11-02 19:55:57
314
原创 流水灯设计
module prj(input sys_clk, input sys_rst_n, output reg[7:0] led ); parameter freq_div = 10_000_000; parameter max_time_cnt = freq_div / 2 -1; reg [31:0] time_cnt; reg clk_1hz;always@(posedge sys_clk or negedg...
2021-11-02 19:48:14
59
空空如也
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