FPGA
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FPGA实战
通信游侠
这个作者很懒,什么都没留下…
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windows环境下用python PyFtdi控制ftdi芯片生成方波信号
一、下载zadig-2.7.exe,官网服务器在国外,下载速度很慢,基本上打不开,可以通过下面的链接下载zadig-2.7.exe下载打开之后,通过Options里面的List All Devices,可以看到扫描到的设备信息插入带FTDI FT232H芯片的板子,确保只有这块模块包含FTDI芯片。否则如果修改了其他的设备,会导致其他设备不可用。选择libusbK后点击Replace Driver,等待完成即可二、下载python pyftdi库,直接pip3 install pyftdi即可原创 2022-02-10 14:23:22 · 3229 阅读 · 0 评论 -
【FPGA】Generate Bitstream失败Write Bitstream ERROR
Write Bitstream[Common 17-69] Command failed: This design contains one or more cells for which bitstream generation is not permitted:mb_preset_i/axi_ethernet_0/inst/mac/inst/bd_b764_mac_0_core ()If a new IP Core license was added, in order for the new l原创 2021-12-02 10:09:55 · 9281 阅读 · 0 评论 -
Xilinx Vitis 2020.2运行C语言程序(hello world)
生成xsa文件,可以参考Xilinx Vivado2020.2创建MicroBlaze工程生成xsa文件链接: link.图片: 带尺寸的图片: 居中的图片: 居中并且带尺寸的图片:原创 2021-11-28 11:21:37 · 3938 阅读 · 3 评论 -
Xilinx Vivado2020.2创建MicroBlaze工程生成xsa文件
本教程以Xilinx VCU108 Evaluation Board为例,讲解用Xilinx Vivado 2020.2创建MicroBlaze软核工程,然后再用Xilinx Vitis 2020.2建立Hello World C程序工程的完整操作步骤。1、打开Vivado 2020.2,并新建Project原创 2021-11-26 09:25:59 · 7222 阅读 · 1 评论