Verilog
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fei_sun
这个作者很懒,什么都没留下…
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modelsim仿真出现的问题
右键testbench,Add Wave,快速添加。点击Optimization Options。问题:仿真波形没有结果。原创 2024-09-28 08:41:14 · 253 阅读 · 0 评论 -
计算机组成原理
MIPS 20条 RISC。存储器---->寄存器。原创 2024-09-10 20:23:45 · 106 阅读 · 0 评论 -
基于Verilog HDL的FPGA设计基础
ASIC(Application Specific Integrated Circuit)----专用集成电路。CPLD(Complex Programmable Logic Device)----复杂可编程逻辑器件。HDL(Hardware Description Language)----硬件描述语言。EDA(Electronic Design Automation)----电子设计自动化。例1:用Verilog HDL描述4位和32位的与逻辑。例2:用Verilog HDL描述4位和8位移位寄存器。原创 2024-09-10 17:45:18 · 891 阅读 · 0 评论