FPGA
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xiahouzuoxin
这个作者很懒,什么都没留下…
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学习FPGA的网站推荐
毫无疑问,FPGA的两大主力厂商的主页不容错过,所有资料都原滋原味,http://www.altera.com.cn/http://www.xilinx.com/,这个也可以由中文的,http://china.xilinx.com/比如,altera的Recommended HDL Coding Styles可在官网下http://www.altera.com.cn/liter原创 2014-02-22 12:54:47 · 15925 阅读 · 4 评论 -
关于Quartus ii无法识别Modelsim路径的问题
Error: Can't launch the ModelSim-Altera software -- the path to the location of the executables for the ModelSim-Altera software were not specified or the executables were not found at specified p原创 2014-02-18 13:50:37 · 59786 阅读 · 14 评论 -
Quartus ii中使用testbench文件
Quartus ii版本是13.01,原工程文件名为ex,Quartus要求最顶层.v文件名要与工程名相同,因此顶层.v文件名为ex.v ==== Step1 ====Processing -> Start -> Start Testbench Template Writer生成针对工程的Testbench模板文件原创 2014-02-18 14:20:29 · 36434 阅读 · 0 评论 -
FPGA的复位
关于FGPA的复位当初开始学FPGA的时候,总是疑惑:FPGA不是没有复位管教么,但总在always看到有复位信号。这个复位信号(我们暂且称为rst_n)从哪里来?实际上是可以从两个方面获得的,这与我们的MCU一样。上电自动复位手动按键复位考虑到系统的初始化可能需要一定的时间,需要写一段Verilog代码进行延时复位,这段代码综合后就是上电自动复位的过程,上电自动复原创 2014-04-06 19:35:55 · 22970 阅读 · 0 评论 -
FPGA的边沿检测
以前我曾一度傻乎乎的使用always @ (posedge signal)这样的代码去检测signal的上升沿,闹出了很多问题。当受实验室的一同学指教后,再也不会傻乎乎的这样干了。当然,你看完下文也不会这样干了。检测上升沿的原理:使用高频的时钟对信号进行采样,因此要实现上升沿检测,时钟频率至少要在信号最高频率的2倍以上,否则就可能出现漏检测。具体请参见下面代码原创 2014-04-07 21:58:25 · 9918 阅读 · 1 评论 -
使用Tcl脚本分配FPGA管脚
自动生成Tcl文件Project -> Generate Tcl File for Project...弹出如下对话框,设置脚本路径。编辑引脚使用set_location_assignment分配管脚如下:第一次配制时,没有set_location_assignment语句,自已在set_global_assignment语句下一行添加即可。原创 2014-06-13 10:33:28 · 7178 阅读 · 1 评论