【74LS191/48为可预置的四位二进制加/减法计数器3-9循环显示】2022-3-19

缘由我有电路原理图,想用proteus仿真,但是数码管不亮-嵌入式-CSDN问答
74LS191为可预置的四位二进制加/减法计数器

74ls191引脚功用

RCO进位/借位输出端

MAX/MIN进位/借位输出端

CTEN计数操控端

QA-QD计数输出端

U/D计数操控端

CLK时钟输入端

LOAD异步并行置入端(低电平有用)。

74LS191逻辑功用

 后一个数码管选型看顶上一端CK另一种是CA。下图显示3-9循环。

下图预置3从3-9循环显示 

下图预置3从3-9再从9-3循环显示,必需使用4端全信号,否则可能与其它字段信号混淆.

只有3与7的信号有重复因此需要全信号做区别9信号就不用全信号即可. 

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74LS74是一种双D触发器,可以用来构成二进制计数器。我们可以利用两个74LS74构成一个两位二进制减法计数器。 首先,我们需要明确两个74LS74的输入和输出的定义。74LS74有两个D输入,两个时钟输入,两个输出和两个清零输入。 我们可以将第一个74LS74的D1输入连接到逻辑电路的输入A,在计数器的最低位上。 我们将第二个74LS74的D1输入连接到逻辑电路的输入B,在计数器的次低位上。 第一个74LS74的D0输入保持为高电平逻辑1,所以该输入端不需要连接。 第二个74LS74的D0输入需要连接到第一个74LS74的Q1输出,即第一个74LS74的第一个输出。 两个74LS74的时钟输入端都是连接在一起的,并且连接到计数器的时钟输入端,以确保它们以相同的时钟脉冲进行计数。 两个74LS74的清零输入都连接到计数器的清零输入端,以便在需要时对计数器进行清零操作。 两个74LS74的Q1和Q0输出分别作为两位二进制减法计数器的结果输出。 接下来,我们可以根据输入A和输入B的不同组合,列出两位二进制减法计数器的真值表。真值表的列包括输入A、输入B、输出Q1和输出Q0。 假设输入A和B的所有可能组合分别为00、01、10和11,我们可以根据减法的规则得出结果。 例如,当输入A为00、输入B为01时,减法计算的结果为11,即输出Q1和Q0为11。 根据这样的规则,我们可以逐一列出所有可能的输入组合,并得到对应的输出Q1和Q0。 以上是使用74LS74构成两位二进制减法计数器真值表的方法。

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