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RSS订阅原创 Vivado-ECO修改网表进行加速debug
Vivado加速编译技巧工具方法Vivado在implement时，会将中间过程打包成dcp文件，对dcp文件进行修改可以加速编译，vivado16.4以上版本有Debug和 ECO功能。DCP文件在implement成功后，/xxx.runs/impl_1文件夹下会有xxx_opt.dcp、xxx_placed.dcp、xxx_routed.dcp三个DCP文件。其中xxx_op...
2020-03-15 22:37:53
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原创 Vivado ILA Advanced Trigger的使用
在FPGA工程中经常会因为debug手段有限无法捕捉到错误状态，ila的basic使用能够满足大部分捕捉要求，在不能满足捕捉条件时，编写中间逻辑也可以触发异常状态。vivado提供了 ILA Advanced Trigger，通过编写触发状态机达到触发条件。今天写了简单的debug程序，跑了下 ILA Advanced Trigger，没有太多惊喜，可能小程序，体验不出其特殊价...
2018-09-19 23:30:09
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原创 FPGA设计中计数器的使用技巧
计数器使用很常见也很实用。以下是几个例子1，简单的cnt计数//Verilogreg [31:0] cnt;always @(posedge clk) cnt <= cnt+1;这是一个简单的计数器，计数从0开始计数，计数范围0~2^32-1.2，带有方向的cnt计数//Verilogreg [31:0] cnt = 100;reg cnt_directio...
2018-09-18 22:05:48
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原创 写博一览表
对于FPGA来说，想说爱你不容易，整理了近几年的工作，有以下工作点可以絮叨絮叨。边写边总结，希望对自己也是一个提升吧。 01_FPGA编码技巧 计数器使用（FPGA4fun） 状态机写法（两段和三段） cunning教授的文章摘录 位操作运算（参数化的前提） FPGA参数化编程 02_FPGA静态时序分析 静态时序分析 静态时序约束 TimeQuest静态时序分析...
2018-09-17 23:48:50
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matlab_mobilenet_yolov3.rar
2020-03-01
空空如也
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