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原创 SystemVerilog——字符串
SystemVerilog引入了一个字符串类型(string),它是一个大小可变、动态分配的字节数组。在Verilog中,字符串文本为一个具有宽度为8的整数倍的压缩数组。当一个字符串文本被赋值到一个大小不同、整型压缩数组变量的时候,它或者被截短到变量的大小或者在左侧填补0。在SystemVerilog中,字符串文本的表现行为与Verilog相同。然而,SystemVerilog还支持字符串类型,我们可以将一个字符串文本赋值到这种数据类型。当使用字符串类型来替代一个整型变量的时候,字符串可以具有任意的长度
2022-04-17 21:50:56 3978
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