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次占优先级,也就是响应优先级,只在同一先占优先级的中断同时触发时起作用,先占优先级相同,则优先执行次占优先级较高的中断。次占优先级不会造成中断嵌套。 如果中断的两个优先级都一致,则优先执行位于中断向量表中位置较高的中断。
- NVIC是什么?
嵌套向量中断控制器;用于为中断分组,从而分配抢占优先级和响应优先级;
分组的方式有两种:
(1)Cortex-m3内核提供了一种3位宽度的PRIGROUP数据区,用于指示一个8位数据序列中的小数点的位置,从而表示中断优先级的分组。见下表:
(2)而实际上STM32并没有用到这么多中断,所以在分组上只分了5个组,并且表示方法有所不同;见下表:
我们在应用当中只会用到STM32的分组(5组)方式,所以下面着重于5组分组方式;
二 中断向量表 (STM32F10x系列)
(图片来自STM32使用手册,只需看,不需要熟记,知道大概这么多中断就好)
三 配置中断相关寄存器
/\*
cortex-m3内核分组方式(8组)结构体表达方式:
\*/
typedef struct
{
__IO uint32_t ISER[8]; 中断使能设置寄存器 /\*!< 偏移量: 0x000 Interrupt Set Enable Register \*/
uint32_t RESERVED0[24];
__IO uint32_t ICER[8]; 中断清除使能寄存器 /\*!<偏移量: 0x080 Interrupt Clear Enable Register \*/
uint32_t RSERVED1[24];
__IO uint32_t ISPR[8]; 中断挂起设置寄存器 /\*!< 偏移量: 0x100 Interrupt Set Pending Register \*/
uint32_t RESERVED2[24];
__IO uint32_t ICPR[8]; 中断清除挂起寄存器 /\*!<偏移量: 0x180 Interrupt Clear Pending Register \*/
uint32_t RESERVED3[24];
__IO uint32_t IABR[8]; 中断激活状态位寄存器 /\*!< 偏移量: 0x200 Interrupt Active bit Register \*/
uint32_t RESERVED4[56];
__IO uint8_t IP[240]; 中断优先级寄存器 /\*!< 偏移量: 0x300 Interrupt Priority Register (8Bit wide) \*/
uint32_t RESERVED5[644]; 软件触发方式寄存器
__O uint32_t STIR; /\*!< 偏移量: 0xE00 Software Trigger Interrupt Register \*/
} NVIC_Type;
/\*
STM32分组(5组)方式结构体表达方式
typedef struct
{
vu32 ISER[2];
u32 RESERVED0[30];
vu32 ICER[2];
u32 RSERVED1[30];
vu32 ISPR[2];
u32 RESERVED2[30];
vu32 ICPR[2];
u32 RESERVED3[30];
vu32 IABR[2];
u32 RESERVED4[62];
vu32 IPR[15];
} NVIC\_TypeDef;
\*/
以上寄存器介绍:
对一些概念的解释:
- 挂起:当置位中断挂起寄存器的时候,相应的中断将会被挂起,这是这个中断将不会立即执行,而是等待可执行的时候再执行;比如高低级别的中断同时产生,就先挂起低级别的中断,等高级别的中断执行完毕,解除并执行低级中断;
- 对中断优先级控制寄存器的解释
推荐去观看一位前辈的博客:
http://blog.csdn.net/DLUTXIE/article/details/7059184?locationNum=4&fps=1
四 编程步骤
网上学习资料一大堆,但如果学到的知识不成体系,遇到问题时只是浅尝辄止,不再深入研究,那么很难做到真正的技术提升。
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