西南科技大学数字电子技术实验二（SSI逻辑器件设计组合逻辑电路及FPGA实现 ）FPGA部分

已于 2024-10-22 18:37:20 修改
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分类专栏： 西南科技大学数电实验预习报告与FPGA部分（含综合设计报告） 文章标签： fpga开发 数字电子技术 数电实验 西南科技大学 diamond
于 2023-11-28 12:38:51 首次发布
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该实验旨在掌握SSI逻辑器件设计组合电路和FPGA实现方法。涉及1位半加器、全加器、多数表决器和二进制数比较器的Verilog设计，并通过仿真验证其功能。实验中，学生将学习到组合逻辑电路的调试技巧，解决实验问题，并了解FPGA开发流程。

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一、实验目的     

1、掌握用SSI（小规模集成电路）逻辑器件设计组合电路的方法。

2、掌握组合逻辑电路的调试方法。

3、学会分析和解决实验中遇到的问题。

4、学会用FPGA实现本实验内容。

二、实验原理

包括：原理图绘制和实验原理简述

1、1位半加器

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说明：本实验是验证性实验，计算预测验证结果。是设计性实验一定要从系统指标计算出元。件参数过程，越详细越好。用公式输入法完成相关公式内容，不得贴手写图片。理论效果：调节合适的坐标后，波形图为 3 格高，一周期应为 5 格宽。（2）2 输入与非门逻辑表达式：Y=(A·B)'=(A')+(B')抽象公式直接得出结果，不得分，页数可根据内容调整）（2）方波信号（1MHz、5Vp-p）理论效果：5 格高，一周期 5 格宽。（1）与门逻辑表达式：Y=AB。（4）4 输入与非门。
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进一步理解了用Verilog语言进行编程的过程与其所需要注意的一些要点，能自己用多片74LS161设计出16进制以上的任意进制计数器，经过验证，与预测结果一致，满足计数器的基本功能，能用字发生器（Word generator）产生输入变量，输出状态用逻辑分析仪（Logic Analyzer）检测，根据题目要求简化并设计电路。做实验设计时,应该按步骤设计，首先列真值表，根据真值表列出逻辑函数表达式并化简，再根据化简了的逻辑表达式画出逻辑电路图，选择适当的电路芯片合理布线设计实验线路，最后根据路线写代码。
西南科技大学数字电子技术实验二（SSI逻辑器件设计组合逻辑电路及FPGA实现 ）预习报告
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说明：本实验是验证性实验，计算预测验证结果。是设计性实验一定要从系统指标计算出元件参数过程，越详细越好。用公式输入法完成相关公式内容，不得贴手写图片。（注意：从抽象公式直接得出结果，不得分，页数可根据内容调整）逻辑方程：L=A`B+A`C+BCD。二、画出并填写实验指导书上的预表。三、画出并填写实验指导书上的虚表。四、粘贴原理仿真、工程仿真截图。3、三变量多数表决器。4、1位二进制数比较器。4、1位二进制数比较器。5、四变量多数表决器。3、三变量多数表决器。5、四变量多数表决器。
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3、用二极管正向虚拟IV仪测出数据，并记录数据于虚表3和虚表4。1、按照指导书multisim仿真软件上画出三种模型电路图，1、按照指导书multisim仿真软件上画出三种模型电路图，1、按照指导书multisim仿真软件上画出三种模型电路图，表6 二极管三种模型参数测试表（电源电压=1.2V）2、用万用表测出数据，并记录数据于虚表1和虚表2。2、用万用表测出数据，并记录数据于虚表5和虚表6。表5 二极管三种模型参数测试表（电源电压=12V）二极管三种模型参数测试表（电源电压=12V）
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1、掌握基于 Verilog 语言的 diamond 工具设计全流程。2、熟悉、应用 Verilog HDL 描述数字电路。3、掌握 Verilog HDL 的组合和时序逻辑电路的设计方法。4、掌握“小脚丫”开发板的使用方法。
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