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RSS订阅原创 Verilog数字系统设计——数字时钟（带暂停和任意位置位）
verilog数字时钟设计功能说明问题分析及模块实现模24计数器模60计数器模6计数器模10计数器模60计数器数码管驱动电路11位控制位说明分频器数字时钟顶层文件实现写在后面功能说明本文实现一个采用同步计数，具有暂停以及用11位控制字进行时分秒置位功能的24h数字时钟。问题分析及模块实现数字时钟由时分秒三部分组成，为此需要设计分频器、模24的计数器和模60的计数器，此外为了在多位共阴极数码管上显示，还需要设计数码管的驱动电路，最后，为实现全置位的功能，设计了11位控制字来对复位进行控制。模24计数
2020-12-05 17:13:32
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原创 dji osdk使用的一些问题
错误串口不对串口通信不正常电机不动串口不对运行下面的代码看一下所有串口，确保…/build/bin/UserConfig.txt里面的串口和你在用的对应起来。ls -l /dev/ttyS*权限不够的话用root权限再看sudo su串口通信不正常注意报这个错的原因一般有：Assistant里面没有设置好SDK控制模式，设置一下就好了。不会吧不会吧，不会真有人用osdk还不勾这一项吧波特率不匹配，这个要给他改成匹配的才能正常。比如Assistant 2里面是230400，那…/
2020-07-08 22:56:23
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原创 DJI-OSDK学习笔记 1
DJI-OSDK学习笔记 1 写在前面一些计划结语写在前面此系列博客将为本人在学习DJI-OSDK3.9中的一些笔记，存在的问题会比较多，希望观者有选择地浏览。本篇主要是对如何学习的一些计划。开了一个不一定填的完的坑一些计划参考DJI-OSDK的官方文档链接: link.我在后续的学习中会结合官方的SAMPLE APPLICATION，逐一对这些feature进行学习。结语就这？就这？就这？就这？就这？就这？后续学习笔记会陆续更新。其实还在摸鱼...
2020-07-03 11:27:07
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空空如也
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