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RSS订阅原创 计算机组成原理 实验一 四位加法器设计
先用Verilog HDL语言设计一位全加器电路，再采用原理图方式设计四位加法器，进位方式可采用串行进位或先行进位。
2023-04-10 16:25:39
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原创 西南交通大学数据结构第五次实验报告
数组与广义表基于压缩存储的半三角矩阵乘法运算的实现已知两个n阶下半三角矩阵的乘积仍为n阶下半三角矩阵。编程输入两个n阶下半三角矩阵，输出这两个矩阵的乘积。要求n阶下半三角矩阵采用一维数组压缩存储（即只存储下半三角）。程序先从键盘(或字符文件)输入n值，建立三个矩阵的一维数组动态存储结构，然后从键盘(或字符文件)输入两个半三角矩阵，最后输出计算结果到屏幕上(或另一个字符文件中)。例如：键盘输入为：312 34 5 6-1-2 -3-4 -5 -6则输出为：-1-8 -9-38 -45 -36掌握半三角矩阵
2022-10-31 16:55:46
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空空如也
空空如也
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