[Logisim 头歌实践教学平台]理想流水线设计 MIPS流水CPU设计---HUST（计算机组成原理课程设计）

已于 2024-06-23 19:02:01 修改
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分类专栏： 头歌Logisim 文章标签： 课程设计 单片机 嵌入式硬件
于 2024-06-22 21:07:49 首次发布
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 本代码为原创首发，创作不易，谢谢支持！

实验成品电路图

MIPS流水CPU设计所有实验见该博客：

博客链接

目录

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实验成品电路图

实验目的

实验内容

电路框架

电路引脚

调试技巧与常见故障

实验目的

学生掌握流水接口设计的基本原理，能够将单周期的CPU改造成可以运行无任何冲突冒险程序的理想流水线。

实验内容

将单周期CPU修改为理想流水线。设计流水接口子电路IF/ID、ID/EX、EX/MEM、MEM/WB，并测试联调理想流水线测试.asm程序，Ctrl+k自动仿真，运行17条指令后停机，时钟周期应该是21，由于最后一拍没有计数，周期数显示应该是20。实验基本原理图如下所示：

​

电路框架

cpu24.circ 理想流水线子电路

​

​

注意：可以整体平移引脚框到电路任何位置，但由于电路封装与引脚位置和顺序有关系，所以框内引脚一律不许增删改，哪怕是移动位置调整顺序，改变引脚朝向，也不要在电路中增加额外的引脚，否则测试系统无法测试。

电路引脚
信号位宽功能描述
IF.PC32IF阶段PC值
ID.PC32ID阶段PC值
EX.PC32EX阶段PC值
MEM.PC32MEM阶段PC值
WB.PC32WB阶段PC值
RegWrite1寄存器堆写使能控制信号，直接连寄存器堆WE端口
RDin32寄存器堆写入端口的数据，直接连寄存器堆Din端口
MemWrite1存储器写使能控制信号，接MEM段的RAM上的Str端口
MDin32存储器写入端口的数据，接MEM段的RAM上的Din端口
LedData32LED显示输出值，连数码管输入数据LedData标签

待测电路默认封装如下，提交测试前请检查是否一致，如不一致，检查引脚是否修改过，另外可以通过恢复默认封装功能尝试修复。

​

电路测试

完成设计后，加载 理想流水线测试.hex 程序，测试功能。确认实验完成正确后，可利用文本编辑工具打开 cpu24.circ，将所有文字信息复制粘贴到 educoder 平台的 cpu24.circ 文件中，再点击评测按钮即可进行本关测试。平台会对你设计的电路进行自动测试，为方便测试，请勿修改子电路封装。

​

测试输出结果说明
#信号功能描述
1CLKs时钟计数，表明当前节拍，注意计数为十六进制
2IFPC当前节拍IF段PC的期望值
3IDPC当前节拍ID段PC的期望值
4EXPC当前节拍EX段PC的期望值
5MEMPC当前节拍Mem段PC的期望值
6WBPC当前节拍WB段PC的期望值
7PCerr5位指错字：从左到右分别表示IF、ID、EX、MEM、WB段PC出错的情况，1表示错误，0表示正确
8Werr4位指错字:从左到右分别表示RegW、RDin、MemW、MDin出错的情况，1表示错误，0表示正确
9LEDLED显示输出期望值
10RegW寄存器写使能控制信号的期望值
11RDin寄存器文件写入端口的数据的期望值
12MemW存储器写使能控制信号的期望值
13MDin存储器写入端口的数据的期望值

由于24条指令的测试程序benchmark节拍周期数过多，所以会输出大量信息，educoder平台不支持，所以本测试中使用了精简模式，左侧测试用例部分这里仅仅输出表头，如下图所示

​

右侧实际输出部分仅仅输出表头和错误节拍对应的各监测引脚的标准值，如下图所示

​

如果未能通过测试，系统会输出待测CPU出错的节拍编号，以及当前节拍下各监测引脚的期望值以及出错情况，请根据出错字找出错误，将cpu运行到对应节拍下（注意CLK值为十六进制）进行比对，并根据指令的功能进行调试。

调试技巧与常见故障

私自调整引脚，看下图，很隐蔽的调整

​

第0拍就出错了，我机器上运行好好的啊，最有可能就是你封装不对，查看下电路封装，恢复为默认封装即可！

​

Werr=01000，RegW=0，表示RegWrite信号不对，预期为0，但是你的信号为1，造成这个的原因是RegWrite信号连接的位置不对，应该连接写回段的RegWrite信号，也就是直接连接寄存器堆的WE使能端，不要连ID段控制器的RegWrite输出。

​

​

出现以上故障，是因为本地 cs3410.jar 和测试平台中的 cs3410.jar 路径不一样导致的。一般建议本地的 jar 文件和 cpu.circ 文件在同一目录下，如果出现这个问题，可以将本地 cs3410.jar 先移动到 cpu.circ 同目录下后，打开 cpu.circ，logisim 会提示找不到 cs3410.jar，重新指向同目录 cs3410.jar，存盘退出，再重新上传电路文本内容，即可解决这个问题。

也可以直接修改平台代码，搜索 cs3410，如下所示：
  1. <lib desc="jar#6.CPU设计实验/cs3410.jar#edu.cornell.cs3410.Components" name="7">

将上面的绝对路径删除，改成如下形式即可：
  1. <lib desc="jar#cs3410.jar#edu.cornell.cs3410.Components" name="7">

开始你的闯关任务吧，升级打怪中....

我想明天去码头整点薯条
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专栏目录
MIPS运算器设计实验报告（完整）+代码
07-19
华中科技大学计算机组成原理实验报告（完整）+代码参考 ---自己写的 报告+代码都是自己写的，可以跑出来 1.理解算术逻辑运算单元（ALU）的基本构成 2.掌握 Logisim 中各种运算组件的使用方法，熟悉多路选择器的使用 3.能利用前述实验完成的 32 位加法器、 Logisim 中的运算组件构造指定规格的 ALU 单元
头歌实践教学平台 MIPS流水CPU设计---HUST
05-14
本实验从 MIPS 单周期 CPU 开始逐步构建无冲突冒险的理想指令流水线，能处理分支相关的指令流水线，采用气泡处理数据相关的气泡式流水线，采用重定向解决数据相关的重定向流水线。并最终在 MIPS 五段流水线上实现动态分支预测技术。 第1关：单周期CPU(24条指令).txt 第2关：理想流水线设计.txt 第3关：气泡流水线设计(EX段分支3624版本).txt 第4关：重定向流水线(EX段分支2298版本).txt 第7关：单周期MIPS+单级中断.txt 第9关：多级嵌套中断(EPC内存堆栈保存).txt （其余关卡还在持续更新当中……）
【Logisim】MIPS CPU设计、理想指令流水线设计
07-16
1、了解单周期MIPS CPU架构，为程序设计控制器。 2、了解MIPS指令流水线基本概念，和理想指令流水线的设计。 华中科技大学《计算机硬件系统设计》
MIPS CPU设计（基于华中科技大学计组实验）
qq_59961910的博客
05-21 990
我们可以根据指令的操作码op传送到控制器中就可以知道，当前控制的需要进行的操作是那一个，然后就是需要把Rs，Rt，Rd送到寄存器中，让寄存器在输出两个值，当不是J指令的时候我们就让PC计数器的值加上4，如果是J指令的时候就直接让PC计数器的值等于我们要跳转的地址，这个地方的值需要用到一个数据选择器实现。本次实验要求我们掌握的是MIPS CPU设计，而此实验中关注的重点是在计算机中的cpu的运行模式，这个模式可以参考冯诺伊曼的计算机架构去理解，还需要知道的是指令格式和指令在计算机中是如何解析的。
头歌实践教学平台 MIPS CPU设计(HUST)
04-05
本实训项目将帮助学生掌握 CPU 控制器设计的基本原理，能利用硬布线控制器的设计原理在 Logisim 平台中设计实现支持五条指令的 MIPS 单周期 CPU，该处理器能运行简单的内存冒泡排序程序。能利用硬布线控制器以及微程序控制器的原理设计实现 MIPS 多周期 CPU。 第1关：单周期MIPS CPU设计.txt 第2关：微程序地址转移逻辑设计.txt 第3关：MIPS微程序CPU设计.txt 第4关：硬布线控制器状态机设计.txt 第5关：多周期MIPS硬布线控制器CPU设计（排序程序）.txt 存储器第七关.txt HUST1.txt 以下内容因还在构建中，还请谅解…… 第6关：单周期CPU单级中断机制设计(构建中) 第7关：单周期CPU多级中断机制设计---硬件堆栈(构建中) 第8关：单周期CPU多级中断机制设计---内存堆栈(构建中)
[计算机组成原理课程设计]MIPS流水CPU设计---HUST（Logisim 头歌实践教学平台）理想流水线 气泡流水线 重定向流水线(ID段分支2103版本)(EX段分支2298版本)
That_Day_的博客
06-17 1112
理想流水线 气泡流水线设计(EX段分支3624版本) 重定向流水线(EX段分支2298版本) 重定向流水线设计(ID段分支2103版本)
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单总线CPU设计(HUST），一个txt包含全部6个关卡的答案，绝对正确！全网最低价！ 看我看我：一定要注意细节，不要1分钟就把作业全做完了，会被平台查到，10分钟完成一关比较合理，这样子就不会被老师发现啦~自己心里...
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头歌educoder教学实践平台计算机组成原理MIPS CPU设计（HUST),第1关到第5关，源代码txt格式打开。 第1关 单周期MIPS CPU设计 第2关 微程序地址转移逻辑设计 第3关 MIPS微程序CPU设计 第4关 硬布线控制器状态机设计 ...
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qq_59961910的博客
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本章继续讲述计算机硬件系统设计的内容，之前已经大概说明了 ALU 和存储系统的设计，本文讲述CPU的设计。对应的有单周期、多周期 CPU 设计，以及流水线设计，中断处理会在后文中详细说明，本文不进行讲述。本文仅提供设计思路，如有错误还请指正，也希望各位读者可以提供宝贵意见与指导，共同探讨学习。设计不尽完善，还有许多需要改进的地方，希望拙笔可以抛砖引玉，之后可以出现更多完善优秀的设计提供参考。本人也因对硬件设计极为感兴趣，欢迎各位提问交流，最后也衷心祝愿各位读者万事胜意，身体健康。
第6关：气泡流水线设计(ID段分支3309版本) MIPS流水CPU设计---HUST 头歌答案 计组课设
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气泡流水线设计(ID段分支3309版本) MIPS流水CPU设计---HUST 头歌答案 计组课设
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菜单展示购物车展示：提交订单：支付详情页展示：订单查看：查看历史消费：Page({data: {// 显示面板指示点// 图片自动切换// 自动切换时间间隔// 滑动动画时长},// 显示模态对话框。
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与总体产品联调时，需要各个单机系统严格按照总体要求，进行数据输出，时间的偏差将出现系统异常，控制失败等不稳定情况产生，甚至影响到产品安全。因此必须确保某些关键任务的优先执行。单片机任务优先级一般有两种方式实现，和。基于中断服务函数实现的任务优先级对单片机硬件资源有要求，而对于实时操作系统的任务调度方式，仅需一个定时器就可完成多任务多优先级的管理。参与某产品联调时，总体要求每间隔5ms向总控发送一次关键数据。当系统联调运行时，总控会产生超时报警，报警内容是通信超时。
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07-06 842
TIM定时器可以对输入的时钟进行计数，并在计数值达到设定值时触发中断
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07-03 727
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STMF4 硬件IIC（天空星开发板）
最新发布
weixin_62292999的博客
07-06 969
下面只介绍不同的部分。使用宏定义，去写代码，这种函数是能够提升程序的执行速度，因为宏定义是预处理指令，在程序执行前，开始执行的，如果是将函数在次封装在调用，这种程序执行速度是比不上，宏定义。，硬件IIC效率远高于软件IIC， STMF4VET6上带有3个硬件IIC，允许与外部IIC接口进行通信，STMF4的硬件IIC使用特定的引脚复位，来进行数据和时钟信号的传输。来传输数据还有时序信号，达到IIC通信的效果目的，软件IIC通信好处是，在MCU内部没有集成硬件IIC电路的时候，可以使用软件IIC通信，
头歌实践教学平台 mips流水cpu设计---hust
06-28
### 回答1： 头歌实践教学平台是华中科技大学推出的一款在线教育平台，其中包括了MIPS流水CPU设计课程。该课程主要介绍了MIPS流水线CPU的设计原理和实现方法，通过实践操作，帮助学生深入理解CPU的工作原理和计算机体系结构。这门课程对于计算机专业的学生来说非常有价值，可以提高他们的实践能力和编程水平。 ### 回答2： 头歌实践教学平台是华中科技大学自主研发的一个在线教学平台，主要面向全球的计算机及电子工程学习者和爱好者，为用户提供高质量的教育资源和实验环境。其课程覆盖了计算机体系结构、操作系统、编译原理、计算机网络、嵌入式系统等多个方向，每一门课程都有课堂视频、实验内容和动手实验的环节，使学习者能够从学习理论知识到动手实践的全面体验中深度学习，掌握更加综合的知识。 其中，MIPS流水CPU设计是头歌实践教学平台的一门重要课程，该课程的主要目的是通过讲解高性能CPU的结构和原理，让学习者深入了解计算机的工作原理。本课程采用的MIPS指令集架构已被广泛应用于各种处理器的设计中，学生能够深入学习数据通路、流水线、异常处理、高速缓存等CPU设计的核心概念。通过这门课程的学习，学习者将能够掌握硬件描述语言Verilog HDL的基本语法，了解流水线CPU设计的思路和方法，实现一个简单的MIPS流水线CPU，并使用仿真软件ModelSim对其进行测试和验证。 MIPS流水CPU设计课程在头歌实践教学平台上的教学模式独特，有着丰富的课件内容和实验环节。学生可以通过在线课件了解各个子系统的设计和数据通路，使用实验环节完成流水线CPU的设计，并在实验的基础上进行仿真和性能分析。同时，课程中提供了许多的实际应用案例，让学习者能够了解CPU在各种计算机系统中的应用。通过这种独特的教学方式和丰富的课程内容，学生能够获得更加深刻的学习体验和知识积累，为未来的学习和职业发展打下坚实的基础。 ### 回答3： 头歌实践教学平台 Mips流水CPU设计是华中科技大学（HUST）计算机科学与技术专业的一门课程。该课程是一门与硬件相关的高级计算机组成原理课程，着重于教学生如何设计流水线MIPS处理器。 设计MIPS处理器需要学生掌握MIPS指令集架构、计算机组成原理、数字电路设计等知识。学生需要了解MIPS指令的类型、运算机制以及内存和寄存器等部件的操作，以及数电设计中的时序逻辑和组合逻辑等核心知识。 MIPS流水线设计是将指令处理过程分解成多个阶段，并对每个阶段采用不同的硬件进行处理。这种设计可以加快指令的执行，并且可以同时运行多条指令，提高CPU的效率。在学习流水线设计时，学生需要深入了解流水线各个阶段的功能和互连关系，并学习如何解决流水线冒险（数据相关和控制相关）问题。 头歌实践教学平台为学生提供了一个全面的教学环境，包括了教学视频、课程资料、作业等，帮助学生深入学习和理解课程内容。通过参与设计MIPS流水CPU项目，学生将会掌握计算机系统的核心知识，并且获得实践操作能力。同时，该平台为学生提供了与导师和同学互动的机会，促进了学术交流和团队合作。

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