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RSS订阅原创 FPGA开发实验（9）- RGB_LCD显示实验
TFT-LCD，即薄膜晶体管液晶显示屏。它显示的每个像素点都是由集成在液晶后面的薄膜晶体管独立驱动。1.分辨率： LCD 显示器分辨率一般分为 720P、1080P、2K 或 4K等。RGB 灯由 R(红色)、G(绿色)和 B(蓝色)这三种颜色组成的。如：1080P 的意思就是一个 LCD 屏幕上的像素数量是 19201080 个，也就是这个屏幕一列 1080 个像素点，一共 1920 列。2.像素格式：RGB888像素格式一个 R、G、B 这三部分分别使用8bit 的数据，一个像素点就是 8bit。
2024-07-25 09:26:56
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原创 FPGA开发实验（8）- UART串口实验
UART即通用异步收发器，串口是串行接口的简称，两者组合起来就是通用异步串行通信接口，它包括了 RS232、RS499、RS423、RS422 和 RS485等接口标准规范和总线标准规范，因此串口广泛应用于嵌入式、工业控制等领域。1)数据通信的概念通信方式在日常的应用中一般分为串行通信和并行通信。并行通信:并行通信是指多比特数据。
2024-07-25 09:26:49
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原创 FPGA开发实验（7）- IP核之FIFO实验
FIFO 本质上是由 RAM 加读写控制逻辑构成的一种先进先出的数据缓冲器，其与普通存储器 RAM 的区别在于 FIFO 没有外部读写地址线，使用起来非常简单，但 FIFO 只能顺序写入数据，并按顺序读出数据，其数据地址由内部读写指针自动加 1 完成，不能像普通存储器那样可以由地址线决定读取或写入某个指定的地址，不过也正是因为这个特性，使得 FIFO 在使用时并不存在像 RAM 那样的读写冲突问题。
2024-07-22 18:00:59
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原创 FPGA开发实验（6）- IP核之双端口RAM实验
简单双端口 RAM 的端口 A 只能写不能读，端口 B 只能读不能写。与单端口不同的是，伪双端口RAM有两路时钟信号CLKA/CLKB。两个独立的地址ADDRA和ADDRB；PortA提供写数据总线，PortB提供读数据总线。
2024-07-22 15:08:05
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原创 FPGA开发实验（5）- IP核之单端口RAM实验
RAM,即随机存取存储器，简称随机存储器，它可以随时把数据写入任一指定地址的存储单元，也可以随时从任一指定地址的存储单元中读出数据，其读写速度是由时钟频率决定的。存储器的大致分类，如下图所示:存储器包括随机存储器和只读存储器，随机存储器包括静态 RAM 和动态 RAM。静态RAM 只要有供电，它保存的数据就不会丢失；而动态 RAM 在供电的情况下，还需要根据其要求的时间来对存储的数据进行刷新，才能保持存储的数据不会丢失。
2024-07-21 20:31:54
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原创 FPGA开发实验（4）- IP核之PLL实验
PLL即锁相环，是一种时钟反馈电路，其有着强大的性能，可以对FPGA的时钟信号进行任意的分频，倍频，相位调整，占空比调整等。
2024-07-21 14:43:08
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原创 FPGA开发实验（2）- 按键（消抖）控制蜂鸣器实验
*绘制波形图：**我们消抖的过程就是滤除按键值保持时间小于 20ms 的值，那么我们需要做的就是在按键被按下或者被释放导致按键值产生变化时，从 20ms 开始倒计时，如果 20ms 的倒计时还没有完成按键值就再次产生变化，此时需要从头开始 20ms 倒计时，前一次导致按键值变化的操作视为无效操作，将该次变化视为按键抖动消除，否者保留。初始状态为蜂鸣器鸣叫，按下按键后蜂鸣器停止鸣叫，再次按下开关，蜂鸣器重新鸣叫。按键消抖模块我们的输入信号主要有系统时钟信号、系统复位信号与按键输入，输出为按键消抖后的值。
2024-07-20 18:15:56
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原创 FPGA开发实验（1）- LED流水灯实验
本节的实验任务是使用达芬奇开发板上的四个 LED 灯顺序点亮并熄灭，循环往复产生流水灯的效果，流水间隔时间为 0.5s。系统时钟为50MHZ，0.5s需要0.5*50_000_000=25_000_000个时钟周期，所以cnt需要计数25000000-1次。由于0.5s仿真周期太长，所以我们将flow_led.v中的cnt的周期缩短为25。模块flow_led。输入：sys_clk,sys_rst_n。
2024-07-19 16:44:26
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原创 FPGA开发实验（序章）- FPGA开发的前期准备
FPGA,即现场可编程门阵列，是一种半定制数字集成电路，优点为开发周期短，灵活性高，处理能力强（并行）等特点。并行！！！FPGA在通信、图像处理、医疗等领域被广泛运用。本文章采用Xilinx7系列型号为 XC7A35TFGG484I-2的芯片。
2024-07-19 15:08:56
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原创 Linux-ARM裸机开发（二）-I.MX6U 核心板资源
I.MX6ULL是NXP基于ARM Cortex-A7架构的单核处理器家族，主频可以高900MHz。I.MX6ULL应用处理器包含了电源管理模块，可以降低外部电源电路设计的复杂度，并且简化了供电时序。该系列中的每个处理器都提供了丰富的内存接口，包含16-bit的LPDDR2、DDR3、DDR3L，Nand Flash、Nor Flash、eMMC、Quad SPI，还有其它广泛的接口用于连接外设的，比如WLAN、蓝牙、GPS、显示、摄像头等。NANA是一种Flash，也就是闪存。
2023-11-08 17:10:46
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空空如也
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