vivado HLS 实验步骤记录

于 2024-07-27 10:14:39 发布
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文章标签： 嵌入式硬件
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版权

新建工程

①定义top函数

②定义tb文件（包含测试向量）

③设置器件型号

④定义端口输入时钟

⑤定义输出配置（默认：导出IP、语言verilog）

模拟仿真

①C simulation

目的：对代码功能进行逻辑验证（需要使用tb和测试向量）

②C synthsis

目的：高级语言综合成RTL

结果

③Co-simulation协同仿真

④导出IP

Solution --->Export RTL

52Hz鲸_孑
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