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FPGA/CPLD
面如平湖
这个作者很懒,什么都没留下…
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Reset distribution tree
上图中的复位树来自于一个经过延迟和缓冲的时钟,为了保证复位信号能够更快地到达各个Flip-flop,可以采用下图的架构: 第二幅图中的复位同步电路与时钟树并行,比第一种实现方式更为优化。 布局布线之后的时序分析应该确保异步复位信号释放时和使能时都满足建立时间和保持时间的要求。原创 2013-08-06 10:23:36 · 1375 阅读 · 0 评论 -
ISE使用过程中遇到的一个诡异问题
今天在使用ISE进行工程编译时发现一个诡异的问题,提示信息如下:ERROR:Pack:1107 - Pack was unable to combine the symbols listed below into a single IOB component because the site type selected is not compatible. 起初怀疑是原理图设计原创 2013-08-17 17:29:08 · 11105 阅读 · 2 评论