VHDL if ( x =(x’range => ‘0’)) VHDL中遇到VHDL if ( x =(x’range => ‘0’))这种语法,之前也遇到过,当时弄明白了,现在过了一段时间又忘记了,好记性不如烂笔头,还是要及时做笔记哟。 这句话的意思是如果x只包含0,那么此条件为true,就可以执行if后面的操作了。这是一种不依赖于x大小的写法。