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2025-05-22 19:30:14
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原创 声学测温度原理解释
FPGA 通过测距雷达测温度,固定测量距离,或者可以测出当前距离。已知距离,然后雷达发出声波到接收到回波的时间,可以计算出声速。通过声速,可以得到当前温度。ultrasound_controller.v雷达控制,产生10us脉冲,然后接收反射波,然后计算出接收和发出的时间差。clkdiv_generation.v–时钟分频,产生100KHz频率的一个时钟使能信号,即每10us产生一个时钟脉冲。temp_cal.v温度计算,通过时间差计算出声速。通过声速计算出当前温度。已知声速,就可以得到温度。
2025-04-11 21:54:32
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以创龙科技 TL3568F-EVM评估板(瑞芯微 RK3568J + 紫光同创 Logos - 2)为核心,搭配TL7606P模块(CL1606/AD7606芯片,8通道,采样率 200KSPS)与TL7616P模块(CL1616/AD7616 芯片,16通道,采样率 1MSPS),构成了一套完备且坚实的硬件开发基础,为开发者的创新实践提供有力支撑。在工业控制与数据采集这片充满挑战的领域中,高精度AD采集如同精密的感知触角,实时显示恰似直观的洞察之窗,它们是确保系统高效、稳定运转的关键所在。
2025-03-28 11:52:51
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转载 第七届“复微杯“2025全国大学生电子设计大赛正式启动!
2021年登陆上交所科创板,形成“A+H”资本格局。“复微杯”全国大学生电子设计大赛是一项大学生科技竞赛活动,旨在加强我国电子专业高校学生自主创新意识和工程实践能力,激发学生对电子技术相关领域的学习和研究兴趣,提高动手能力,为我国集成电路产业培养大批优秀的后备人才。以竞赛促学习,以培训促提升,产学研协同创新,积聚优质项目,引导创业实践,助力我国集成电路产业快速发展。在“复微杯”,同学们不仅能提升专业技能,开拓眼界,强化实践能力,积累项目经验,同时能够结识优秀同学,获取市场信息,更全面地了解行业发展。
2025-03-25 09:29:30
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2025-03-25 09:29:30
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2025-03-25 09:29:30
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原创 ZYNQ 双核AMP模式下,CPU0可以响应外部中断,CPU1响应不了外部中断?
zynq 启用裸机双核cpu,采用AMP模式,PL端采用双DMA,DMA0数据连接CPU0,DMA1连接CPU1,双核都跑起来了,但是CPU0接收DMA0的中断正常,CPU1接收不到DMA1的中断。DMA中断属于SPI中断,在CPU1 “-DUSE_AMP=1”配置下,所有中断默认连接CPU0。所以CPU1接收不到中断。
2025-02-26 13:59:47
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原创 ZYNQ 双核CPU跑 测试用例
Xilinx 的 ZYNQ SOC 融合了这两种架构, ZYNQ SOC 芯片包含两个独立的 Cortex-A9 处理器,这两个处理器核在结构上是相同的,同时又包括了可编程的逻辑单元( PL),使得 ZYNQ 整体系统成为了一个异构多核系统,同时具有较高的通用性和性能。从软件的角度看,多核处理器的运行模式有 AMP(非对称多处理)、 SMP(对称多处理)和 BMP(受约束多处理)三种运行模式。
2025-02-24 16:33:51
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转载 基于国产FPGA的全开源双目视觉处理系统
1. 系统架构解析本系统基于米尔MYC-YM90X构建,搭载安路DR1 FPGA SOC 创新型异构计算平台,充分发挥其双核Cortex-A35处理器与可编程逻辑(PL)单元的协同优势。通过AXI4-Stream总线构建的高速数据通道(峰值带宽可达12.8GB/s),实现ARM与FPGA间的纳秒级(ns)延迟交互,较传统方案提升了3倍的传输效率,极大地提升了系统整体性能。国产化技术亮点:全自主AX...
2025-02-21 11:31:07
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原创 FPGA VGA timing
VGA接口通过传输红、绿、蓝三原色信号以及行同步(HSYNC)和场同步(VSYNC)信号,实现视频图像的显示。场同步(VSYNC):用于每帧扫描的同步信号,与行同步类似,保持低电平一段时间,其余时间保持高电平。这个区域用于稳定电子束的扫描速度,并准备进入下一行的图像数据区域。这个区域用于稳定电子束的扫描速度,并准备进入下一帧的图像数据区域。这个区域用于电子束的复位和准备下一行的扫描。图像数据处理:在像素时钟的驱动下,根据当前扫描的位置,从图像缓冲区中读取相应的图像数据,并输出到VGA接口。
2025-02-08 14:58:35
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原创 verilog 同步fifo
其中,计数器法是一种常用的实现方式,它通过一个计数器来跟踪FIFO中数据的数量,并根据计数器的值来判断FIFO的空满状态。读写指针:用于跟踪已写入和已读取的数据位置。这个存储单元是FIFO的核心,它决定了FIFO可以存储的数据量,即FIFO的深度。满标志:当写入指针的下一个位置等于读取指针时(考虑到循环存储的情况),可以认为FIFO已满,因为此时没有额外的存储空间来写入新的数据。写操作:当写使能信号有效且FIFO未满时,数据会被写入到写入指针指向的存储位置中,然后写入指针会递增以指向下一个可用的存储位置。
2025-02-08 14:24:57
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