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20.仿真正确后，就可以进行引脚约束从而进行板级仿真了，点击implementation,跳回变异界面，点击I/O pin planning(planahead) -post-systhesis 打开引脚约束软件。3.这里设置FPGA信息，我是用的FPGA是Kintex7系列的xc7k325t，封装FFG900，速度-2，仿真工具ISE自带的ISim，语言选Verilog，next~11.原理图生成了，便没有语法错误，接下来进行功能仿真，检查逻辑错误。16.在测试文件里修改一行代码，A置1，点击保存。
2024-06-26 17:27:07
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原创 虚拟机win10安装ise14.7时报错virtualization is not enabled in BIOS
按第二个就可以了，虽然里面适用情况没有win10。
2024-06-26 15:47:40
299
空空如也
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