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原创 python学习之二:导入模块import

可将模块视为扩展,通过将其导入可以扩展。要导入模块,可使用特殊命令。,可在调用函数时不指定模块前缀。

2023-08-09 17:11:00 74 1

原创 UVM搭建学习之五:封装成agent

is_active是uvm_agent的一个成员变量,而uvm_active_passive_enum是一个枚举类型变量,其定义为:typedef enum bit { UVM_PASSIVE=0, UVM_ACTIVE=1 } uvm_active_passive_enum;monitor之间的联系两者之间的代码高度相似。其本质是因为二者处理的是同一种协议,在同样一套既定的规则下做着不同的事情。由于二者的这种相似性,UVM中通常将二者封装在一起,成为一个。

2023-08-09 09:52:58 205 1

原创 UVM搭建学习之四:容器类uvm_env

factory机制注册过的类才能使用这种方式实例化;只有使 用这种方式实例化的实例,才能使用后文要讲述的。factory机制中最为强大的重载功能。验证平台中的组件在实例化时都应该使用 type_name。uvm_component_utils宏来实现factory。在UVM中,这个容器类称为uvm_env。一样,容器类在仿真中也是一直存在的,使用。scoreboard等,在这个容器类中实例化。

2023-08-09 09:31:37 166 1

原创 DVE无法trace波形的原因

在使用dve过程中,突然发现,无法trace信号,不能找到信号输入和输出给谁,在debug中使用极不方便;需要link to source,如果选择link to path schematic,则会产生电路图;需要add trace to wave window 打钩;

2023-08-07 17:04:29 252 1

原创 python学习之一:input

1、说明交互式界面输入,这个数被input(以文本或字符串的方式)返回;2、举例说明x: 34y: 421428。

2023-08-03 19:53:14 25

原创 ffmpeg在linux下解压和编译

1、首先将ffmpeg.zip解压成ffmpeg文件夹下。3、进行build文件夹,执行编译命令。2、然后创建新的文件夹。

2023-08-03 15:43:27 112

原创 UVM搭建学习之三:interface

函数都有四个参数,这两个函数的第三个参数必须完全一致。函数的第四个参数表示要将哪个interface,通过。在类里面声明必须是无实体的,否则会报语法错误;set函数的第二个参数表示的是路径索引;跟top_tb的input_if连接;避免绝对路径的另外一种方式是使用。函数的第四个参数表示把得到的。4、跟top_tb的连接。操作,可以简单地理解成是。

2023-08-02 20:20:51 820

原创 UVM搭建学习之二:factory机制

只要在定义一个新的类时使用这个宏,就相当于把这个类注册到了这张。这个宏所做的事情非常多,其中之一就是将。my_driver登记在 UVM。内部的一张表中,这张表是。

2023-08-02 19:56:08 57

原创 ffmpeg 将yuv转换为jpeg

pix_fmt:因为输入yuv图像是420sp,所以此时格式为nv12;frame0.jpeg: 输出jpeg结果;1、将420sp yuv图像转成jpeg;4、linux显示jpeg命令。-s:输入图像宽高;-i:输入yuv图像。

2023-08-02 19:43:32 1469

原创 UVM搭建学习一:include和import

说明:通过import语句将整个uvm_pkg导入验证平台中。只有导入了这个库,编译器在编译my_driver.sv文件时才会认识其中的uvm_driver等类名。说明:把uvm_macros.svh文件通过include语句包含进来。这是UVM中的一个文件,里面包含了众多的宏定义,只需要包含一次。1、include头文件。

2023-08-01 11:20:05 751 1

原创 如何用SystemVerilog直接调用外部的可执行程序

systemverilog,命令,比对文件

2023-08-01 10:44:46 176

原创 dve查看Verilog覆盖率方法

上图是代码覆盖率的情况,包括score,line,toggle,fsm,codition,branch;其中cm/rkvdec_transd_top_base_code.vdb为覆盖率收集的路径;

2023-08-01 10:26:58 1010

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